signal bus setup设置问题

鱿鱼1 · 发表于 2014-1-26 17:47

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请教各位大神，我设置了si setup 和design audit后，设置signal bus setup为啥assign bus component buffer models 还是没有东西？

cousins · 发表于 2014-1-27 14:28

你没有Assign Model

鱿鱼1 · 发表于 2014-2-8 09:30

我附模型了的

cousins · 发表于 2014-2-8 09:35

那么simulation bus里的signal你assign了吗

鱿鱼1 · 发表于 2014-2-8 09:47

有，我现在有点怀疑是不是软件没有装好

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[Cadence Sigrity] signal bus setup设置问题