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[仿真讨论] 各階段的SI仿真的重要性.

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1#
发表于 2014-3-3 15:43 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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各階段的SI仿真的重要性.9 E0 j* u4 B  r  g- v: l

- I0 ~5 f- N$ F; s& {( x- @SI仿真一般被分為兩大階段, 大家耳熟能詳的+ w$ ^$ d/ g: z( d+ b* C
1) Pre-simulation (circuit simulator)! P) W3 T2 Y! `+ \
2) Post-simulation (2.5D, 3D simulator)" z! c2 f& R% |* m; E

. S2 D; M/ u. _8 d( n至於各個仿真階段的定義及作用小弟在此就不多作贅述.
0 \! b6 x+ `  P! \
3 g$ l% L- I+ N$ F/ q, h& \最近, 有些開發商開始議論Pre仿真的實用性. 認為Pre仿真不能完全反映電路板的實況.
: R( n- U* [; D+ u- U+ ~以DDR3拓譜為例, 即使在Pre仿真階段進行parameter sweep後所總結成的layout design guide, 在很多實際layout情況下是無法被採用的.$ x; ~4 v6 Q6 A* C# f
而且DDR3,PCIe等高速inteRFace是屬於相當成熟的技術, 不論採用什麼樣的拓譜也無需從新仿真.
0 ?- A0 n8 _6 w- ^4 |% Q  ]& [. e; D$ r* s+ c2 g' E7 j
基於上述原因,一些開發商放棄Pre仿真而改用另一種更接近實際情況的Simulation, 稱為Interactive Simulation. 即使用2.5D Simulator來仿真worst-case,從而產生layout design guideline. 最後再run一次總的Post仿真(全程不涉及circuit simulation)- v1 H1 k  N7 x
純屬小弟的愚見,照這樣的情況而言,ANSYS Designer,Agilent ADS等擁有circuit simulator的仿真軟件不就慘了??!
( \- K( f; w& r/ p; O2 C我總覺得Pre仿真circuit simulation有一定的存在價值, 才疏學淺無法說出一個所以然...( _. U% J2 W, C* @/ j1 b0 L( ~4 B

6 i( X, [# M8 C# F8 X各位大俠對此有何高見還望不吝賜教!

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发表于 2014-4-2 20:41 | 只看该作者
一般系统设计中负责把关决策的,会同时重视前仿和后仿,前期投入精力也会比较大。1 `0 u# T- b4 D' ^5 A2 T
负责软件操作的工程师,后仿真工作量可能较大,负责决策的人会追着要结果的。5 G* t9 T( J& v
怎么布线、走哪一层、怎么走、怎么做阻抗优化,电源GND平面怎么安排、去耦电容放多少、磁珠滤波器怎么设计。。。。等等N多东西布线前都要定了下来,要不然布线结束后很难办,尤其是走线比较密的板子,布完线再改,简直就是一场噩梦。

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发表于 2014-3-22 10:22 | 只看该作者
早期的仿真速率低,拓扑结构复杂,通常通过前仿真来定层叠,定布局。- d1 t$ t  z# a2 h% {$ g7 l5 X
仿真起步都大约从cadence开始。所以先入为主,大家都有前仿,后仿的概论。9 @4 W) x4 u2 F  \' A( w" g
现在芯片速率高,高速信号大多都是点对点,在设计PCB之前,有专门的工艺工程师
% P) M# X  d1 ~1 u帮你确定了叠层。所以前仿是做的越来越少,多是布完线直接去仿真套规范。
3 x( k; K* x! ^3 LOK就直接做PCB了。所以不必拘泥于前后,你想做,前后都是可以做的。

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 楼主| 发表于 2014-3-4 17:22 | 只看该作者
稍作一點贅述...1 ~$ x  I7 E+ a( W8 i
1) 在系統總體設計之初, 進行關鍵信號分析: 如I/O, 連接器選型
9 S( H3 k3 }6 j5 Q: I2) 在原圖設計中, 根據信號完整性問題的起源和減小這些問題的總體仿真, 給出布綫的指導規則, 并設計噪聲与時序裕量
1 A  _7 Z  r) l5 p0 l1 B( q3) 在布局与物理實現時, 進行時序和拓扑結構設計, 端子調整, 串擾, 反射, SSN分析与仿真. M8 D' L' ^1 |+ S1 \# e$ m$ E- I/ r
4) 在完成布局後, 進行系統級仿真驗證  {& _) f7 U* m9 f6 O) w5 o

8 l) Y0 V9 l" i/ l: sCousins的意思是1)能去掉?

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2#
发表于 2014-3-3 18:02 | 只看该作者
circuit simulator 也是要做post的8 \/ J) L3 g2 n. g6 `
提取通道后也要做时域分析,大多数3D软件都是基于频域,且不支持多样性的时域激励源。
/ n% p" \2 O, z3 {$ E* |; K- x

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3#
 楼主| 发表于 2014-3-3 18:26 | 只看该作者
感謝cousins.! ]% C8 f8 S! w. C" Q) U6 S2 {
不好意思, 小弟不太明白您的意思. 能否再詳細說明一些?
7 m3 \7 A3 x" {* C  q! K3 ^2 l! B, S# `3 o
我對Pre和Post Simulation的了解比較死板. 可以說是不甚了解.8 z; F! x* L6 G+ i* m
Pre: 拓譜, 反射, 耦合, 終端阻抗, Timing分析, 最後生成Layout用的guideline.4 Z6 B" o5 J2 x  v* p
Post: 抽取電路板model, 檢查是否符合guideline, 并与measurement做correlation" h5 F8 ~; `" D' i8 |- Q
* y8 d; I  r, u0 S+ U1 g
但是interactive simulation的出現, 搞得我一頭霧水了...

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4#
发表于 2014-3-4 14:33 | 只看该作者
详细的来讲...
) k  D2 v1 }# _% [就是post里其实已经包括了pre的内容,只不过把pre中的理想通道模型做成了实际的结构尺寸,考虑了实际拓补中出现的非理想参数影响,你要做的就是把这些实际的结构尺寸变为各种模型,RLGC,SPICE,SCATTERING等等,然后加你在pre的时候加的信号源做通道分析。

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5#
 楼主| 发表于 2014-3-4 16:17 | 只看该作者
弱弱地問一下, 那沒有了pre的話, post能成立嗎??

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6#
发表于 2014-3-4 16:22 | 只看该作者
当然可以$ o. u: g+ R, y
pre是layout前布局拓补加布线约束分析
4 N4 ^% \* u( g+ P. lpost是都完成后的分析,准确度更高
- E# r+ Z- H, d/ B; v+ e. J! \

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7#
 楼主| 发表于 2014-3-4 17:09 | 只看该作者
我上傳了一個圖, 希望能更好得表達我的意思..3 R) E5 |6 t6 G
" |3 A4 d# l6 m
按照cousins的意思, 成熟的高速通道設計不需要遵循一般的設計流程而直接跳到post分析?
& \3 E5 W; Z9 t( {. o還望指教...

设计方法学.pdf

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8#
 楼主| 发表于 2014-3-4 17:10 | 只看该作者
成熟的高速通道如DDR, PCIe等等

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10#
发表于 2014-3-4 17:59 | 只看该作者
我可没说能去掉。
+ c' i3 c9 ~( ?/ n我的意思是post所做部分是实际模型的pre,pre则为理想拓补加模型。post所做的内容和pre是一个包含的关系。% I$ s0 q( @% ^
至于完整的设计递进流程,是肯定要做pre的,pre能生成初期的布线约束。3 F5 s! r" ?0 M! l

) _# m( O* ~1 G& _* y3 {

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11#
 楼主| 发表于 2014-3-4 18:07 | 只看该作者
可我公司想直接跳過pre啊... 我又沒能力說服...) j( L* M; R3 x5 N  w4 O( x2 p. k+ ^

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12#
发表于 2014-3-4 19:40 | 只看该作者
只要你们公司有自己的技术沉淀,跳过是可以的

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13#
 楼主| 发表于 2014-3-5 06:44 | 只看该作者
可惜沒有呢... 都是新手入門, 能否分享一下為何得一起做Pre和Post, 而且缺一不可的一些有力的理由...
# T; ]6 w0 N( }1 U+ ]( I如果有實例分享, 小弟實在無以為報了....

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14#
发表于 2014-3-5 12:28 | 只看该作者
你的理由再充分也没用,公司有自己的考量,不会为了你一个人的意见改变大局,除非你的在公司影响力够大。多做一段时间吧,只有碰到问题才能证明你的观点。没有碰到问题的话,那就把设计规则总结起来,也是宝贵的知识。

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15#
 楼主| 发表于 2014-3-5 15:02 | 只看该作者
Cousins說得非常有道理...1 y. m7 N7 q7 _) Y# M/ l8 T
我會盡量學起來的!
' t8 [! K2 n- G2 G# j3 \1 i: G1 G; j6 T) N/ |+ e- W/ X7 B. R
感謝!
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