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2D line 如元件外框 為什麼設于all layer ? 期待大家討論關注..

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1#
发表于 2008-8-29 18:56 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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情況說明:
% x2 E" Q3 L4 q5 E我在DECAL DEIT環境下分別在primary component layer & silkscreen top & all layer 用2d line畫元件邊線.后保存為part type. " s( `0 p8 ~9 V$ `  _; J& |
調入pcb layout后,經板層色彩設置后,三個邊線均正常顯示.(當然,在silkscreen top上的邊線顯示為黃色,其餘兩個邊線顯示則一致為灰色).但在導出cam時,我只應用默認設置導出.發現在cam中打開后,唯獨不見primary component layer的邊線顯示..
& F+ F1 u2 m! k6 U! n" w經本人苦思冥想,終于知道為何...原來在cam輸出設置時,不可應用默認設置(我指的是如果你的邊線設在了top layer的話).在select items中設置primary component side的items on primary 要勾選outlines一項,如此作previw便可發現設置在primary component layer的元件邊線終於露出了可愛的面目.如下所示:& `( g) Y  b4 B6 z9 k  M# x

8 ]5 ~% P% D. T0 `! B7 U% [以上只是自己摸索出的一些設置,但可惜的是只是解決了具體的問題,卻無法總結出真正的原由....
4 p7 K3 W2 e% h+ H* y於是便不可避免地產生了以下問題,希望版主可以指點一二.....; C: K( l; r2 a
2D line 如元件外框 為什麼設于top layer ?設于all layer為什麼也是在layout中可以顯示的?
: o8 b5 y% O% K1 r兩者有區別嗎?
- V7 w# }/ B* `9 ~& c& a8 a為什麼又可以設於silkscreen layer? % G- v' B# m) I5 k8 |9 q
且以上三种設置均是可以輸出gerber的?
6 }4 y6 [0 C9 M( g( C0 }2 d它們各自的分工究竟是怎樣的?6 `) V" D/ v$ d. w6 ~* v
以上菜鳥問題,還請高人指點.謝謝.  [* U+ e5 m6 P: R( V

; h  j: ]/ C7 n( `+ o$ x* E[ 本帖最后由 stqw1987 于 2008-8-29 20:36 编辑 ]

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2#
发表于 2008-8-29 20:12 | 只看该作者
元件外框建议设于all layer$ S1 i( Y5 v6 ?! J3 o3 i% Y* M0 w
+ U5 P( E7 Q: S4 \, v. }
之所以不设在screen或top,是因为出丝印层的gerber时,系统默认是all layer.
/ t4 m9 e/ _- q+ h  R
9 I5 V; N2 m0 ^  i. S当然,你也可以设在screnn或top层,但是出gerber时要添加进来.
1 Y  G* ?) B+ ^6 ^) ^9 @3 s
3 M- C2 Y/ Y! z3 A1 B建议:做元件封装时外框统一设置在同一层。

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3#
发表于 2008-9-2 10:02 | 只看该作者
https://www.eda365.com/viewthread.php?tid=4756&page=1#pid40952
! {2 K+ V% Z" p10#,希望对LZ理解有所帮助。

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4#
 楼主| 发表于 2008-9-2 21:46 | 只看该作者
我看了,不過覺得不知所以然....
: O& ^% M- e! L) k, y% ^, Y這不,在導入時也碰到了各那個LZ一樣的問題,可是我的這個可能更難一點啊....- H, u8 i( Q5 i' y! h
https://www.eda365.com/thread-10203-1-1.html2 @, b' z; J" Q/ t
還請高人指點.) e- K' B8 b4 R/ z: Y/ N/ ]9 @
$ S2 y* R1 \  U- ~# J3 c
[ 本帖最后由 stqw1987 于 2008-9-2 21:48 编辑 ]

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5#
发表于 2008-9-3 09:29 | 只看该作者
Original posted by stqw1987 at 2008-9-2 21:46 . U$ Z. z5 L; f9 F% e6 \  X" `
我看了,不過覺得不知所以然....; S3 d/ r4 [7 c  F6 [
這不,在導入時也碰到了各那個LZ一樣的問題,可是我的這個可能更難一點啊....* |3 D- ?# x: f9 T0 U
https://www.eda365.com/thread-10203-1-1.html
% H5 w) x1 `4 r$ V! C; k還請高人指點.
$ W' ^5 E2 [0 Z- A9 r0 r) V2 S/ y4 @5 r( r1 g
[ 本帖最后由 stqw1987 于 2008-9-2 21: ...

; p3 T5 o8 }% f. J9 x% M/ A可能是我表达问题,哈哈,如果实在看不明白,咱们可以通过邮件慢慢讨论,我的邮箱请见签名档。
' R5 \# j' E" E- L难怪有这么多人在问这问题最近,唉。。。。。

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6#
发表于 2008-9-3 17:42 | 只看该作者
元件外框设为ALL LAYER层,就说明在任何一层,外框都能显示出来,而元件封装本身有个属性,TOP/BOTTOM,而外框是属于元件封装的,所以元件封装在哪层,也就跟着是哪层了。 总之就是将外框设为ALL LAYER层的好处就是外框始终是与封装在同一层。不知我的理解正确与否。

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7#
发表于 2008-9-6 15:44 | 只看该作者
正确!就是如果在封装里标注字符如:1脚orVCC等就会在DRC时出错的。

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8#
发表于 2008-9-6 19:14 | 只看该作者
怎么是繁体字呢

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9#
发表于 2008-9-6 22:54 | 只看该作者
个人认为这个比较灵活    也就自已灵活处理
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