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sip 的cadence allegro sip、apd中原理图怎么设计

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1#
发表于 2015-9-28 18:57 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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sip 的cadence  allegro sip、apd中原理图怎么设计
- y# m) b4 V9 Z$ B6 R9 s' f6 W) ~1 O+ x用什么设计
) H0 p1 i  h& @# n7 L7 p3 C请那位大侠给指点一下) I3 i8 n  x8 C
非常感谢!!!!
) L* o/ j% d5 u. `6 ?3 I$ Z5 {) x' w* g

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2#
发表于 2015-9-30 16:16 来自手机 | 只看该作者
跟PCB的原理图一样

点评

问两个问题:1‘ 原理图的器件和我们所做的die的package symbol是如何关联的?我看了你写的那本书,感觉这个问题还是不甚明朗。毕竟wb是从die上出来的; 2、sip作为一个器件对外,设计的时候肯定有脚是悬空作为外部  详情 回复 发表于 2016-10-21 11:18

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3#
发表于 2016-10-21 11:18 | 只看该作者
pjh02032121 发表于 2015-9-30 16:16, N% s3 o% {& j+ l3 I
跟PCB的原理图一样

( p6 G3 l$ G! d! n5 a& C3 q问两个问题:1‘ 原理图的器件和我们所做的die的package symbol是如何关联的?我看了你写的那本书,感觉这个问题还是不甚明朗。毕竟wb是从die上出来的;
: O* {( u$ I& v: y; V" N2、sip作为一个器件对外,设计的时候肯定有脚是悬空作为外部连接的,这个时候在原理图上是怎么处理的呢?
6 l8 y8 h; F! h谢谢灯大师
! w8 b6 V( Z0 t1 Z! }( h( t

点评

可以直接原理图里做个封装,也可以直接生成,看你怎样方便就怎么办,不拘形式。  详情 回复 发表于 2016-11-1 19:03

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4#
发表于 2016-11-1 19:03 | 只看该作者
锤子米啊 发表于 2016-10-21 11:189 m7 F  c( M: U2 e( K* l8 B% b4 d
问两个问题:1‘ 原理图的器件和我们所做的die的package symbol是如何关联的?我看了你写的那本书,感觉 ...
# T4 ~- C" `% V, z/ ^3 q: ^! L8 a
可以直接原理图里做个封装,也可以直接生成,看你怎样方便就怎么办,不拘形式。
$ X9 K6 T# [2 I5 d" B3 K

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5#
发表于 2017-3-21 13:32 | 只看该作者
die, 与SIP的中对外器件 单独看做一个器件即可,原理图中把这些器件对应起来就可以了。' Y( B2 a) G" s& o+ D3 g; c
还有简单的 一般不需要原理图。

点评

有个疑问,diepad都大好几千个Pin,做原理图有点复杂啊,有没有快捷一点的方式呢?  详情 回复 发表于 2021-3-18 10:20

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9#
发表于 2021-3-18 10:20 | 只看该作者
denny_9 发表于 2017-3-21 13:32+ S- o! i. h; z5 t, s
die, 与SIP的中对外器件 单独看做一个器件即可,原理图中把这些器件对应起来就可以了。
+ r% V; S8 M! ~% B1 v还有简单的 一般不 ...
; D7 _$ V( W( `
有个疑问,diepad都大好几千个Pin,做原理图有点复杂啊,有没有快捷一点的方式呢?
, K, q5 Q8 ?, }% H
  • TA的每日心情
    擦汗
    2025-9-4 15:01
  • 签到天数: 635 天

    [LV.9]以坛为家II

    11#
    发表于 2024-10-25 17:35 | 只看该作者
    有交流的群吗?有个芯片电容背面接地,正面是接网络的,应该怎么设置这个芯片电容呢
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