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cadence16.6版本加载一次原理图,部分差分就掉了,得重新加差分规则。

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1#
发表于 2016-1-3 22:43 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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cadence16.6版本加载一次原理图,部分差分就掉了,变成单线规则了,得重新加差分规则。哪位高手有遇到过这样的问题,请帮忙解答下。谢谢了!
4 F3 [, N# E; C, L; ~, v

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发表于 2016-1-4 16:07 | 只看该作者

注意不要使用记事本编辑(可能出错),使用UltraEdit编辑


# r6 ~; X" r: W+ B: v2 f! P+ t* ~

点评

这样确实可以解决问题,非常感谢!!  详情 回复 发表于 2016-1-13 19:19

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推荐
发表于 2016-1-4 11:27 | 只看该作者
小小菜 发表于 2016-1-4 10:332 a9 D6 a. q  W1 e
之前也遇到过,可以将线路图里面的电气规则不要传递到pcb里面就可以了
1 j* o. \1 ~4 g# l
是需要怎么设置?学习一下- _/ ]" T* t5 n3 j

点评

导网表界面set up里面更改  详情 回复 发表于 2016-1-4 12:47

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2#
发表于 2016-1-4 09:47 | 只看该作者
盗版软件总有各种问题

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3#
发表于 2016-1-4 10:31 | 只看该作者
是不是原理图里面设置了规则,导入到pcb中了

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4#
发表于 2016-1-4 10:33 | 只看该作者
之前也遇到过,可以将线路图里面的电气规则不要传递到pcb里面就可以了

点评

是需要怎么设置?学习一下  详情 回复 发表于 2016-1-4 11:27

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6#
发表于 2016-1-4 12:47 | 只看该作者
小崔 发表于 2016-1-4 11:271 v; R- R0 v6 f% l% e; m8 u! m: {
是需要怎么设置?学习一下

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8#
 楼主| 发表于 2016-1-13 19:19 | 只看该作者
' v4 B* g7 c+ [6 x2 V, }0 g
这样确实可以解决问题,非常感谢!!
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