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DDR SDRAM绕等长

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发表于 2016-7-4 08:12 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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有谁有关于DDR、SDRAM绕等长的资料呢,求分享0 U9 T1 K& T) h6 y/ ?
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    开心
    2020-5-19 15:39
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    [LV.3]偶尔看看II

    2#
    发表于 2016-7-4 09:05 | 只看该作者
    你想知道什么呢??等长间的误差吗??

    点评

    越详细越好,要是有原理说明就更好了,比如上升沿采样等?  详情 回复 发表于 2016-7-4 10:10
    频率 等长误差一般设置范围等  详情 回复 发表于 2016-7-4 10:09

    该用户从未签到

    3#
     楼主| 发表于 2016-7-4 10:09 | 只看该作者
    980155498cai 发表于 2016-7-4 09:05: G0 s5 ~/ v; @& @
    你想知道什么呢??等长间的误差吗??

    4 H# a6 [6 S6 H频率  等长误差一般设置范围等1 Q( Q/ s+ l) k2 f! ^

    点评

    SDRAM速率不高,误差可以大一点50mil左右,  详情 回复 发表于 2016-7-4 10:55

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    4#
     楼主| 发表于 2016-7-4 10:10 | 只看该作者
    980155498cai 发表于 2016-7-4 09:056 w2 i0 ~; O: G' h  E6 ^
    你想知道什么呢??等长间的误差吗??
    0 A# X. o2 `6 R2 |6 m+ f9 |
    越详细越好,要是有原理说明就更好了,比如上升沿采样等?8 c% g* ~# u8 b* X: Q& \  ]/ q# L
    0 V& I$ k; z; p! h' M
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    5#
    发表于 2016-7-4 10:55 | 只看该作者
    shipaopao 发表于 2016-7-4 10:09
    . v  o( l" s  n+ x6 y频率  等长误差一般设置范围等

    , X# O4 i- G( jSDRAM速率不高,误差可以大一点50mil左右,

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    6#
    发表于 2016-7-4 11:23 | 只看该作者
    我也想知道,来看看

    该用户从未签到

    7#
    发表于 2016-7-4 16:14 | 只看该作者
    数据10mil,地址20mil

    该用户从未签到

    8#
    发表于 2016-7-5 17:03 | 只看该作者
    同一组内DQ与DQS的走线延时差异不得超过+/-5ps
    $ f; |0 ?$ C. d! H8 Q+ E' V地址、控制信号与CK的走线延时差异不得超过+/-25ps
    $ M# \. w  u% B- H对每个DDR3芯片,CK必须晚于DQS到达,延时差值范围0~250ps        我一般data±5 add±100
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    奋斗
    2020-6-24 15:43
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    10#
    发表于 2020-4-1 15:31 | 只看该作者
    数据、地址、控制信号
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