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ddr2跑不起来跟什么有关呢？

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Trista

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1#
发表于 2017-5-25 13:44 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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最近画了一个板子，改了两板都跑不起来，数据线比时钟长了1000MIL，不知道跟这个有没有关系，还是跟网络变压器有关，DDR2下面有个网络变压器，下面挖空的！[img]file:///C:\Users\cdt\AppData\Roaming\Tencent\Users\273291066\QQ\WinTemp\RichOle\@THF~([N@4J]WMY}%)IY(2I.png[/img]* p* z% v1 T) C, k5 S8 y

* p3 \& @. ?/ j+ y  @" S

~0AGT}DJ_$J}%0YRW7L6UWL.png (54.32 KB, 下载次数: 11)

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@THF~([N@4J]WMY}%)IY(2I.png (71.44 KB, 下载次数: 16)

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Trista

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 楼主| 发表于 2017-5-25 16:05 | 只看该作者
小秋2013 发表于 2017-5-25 15:51, a- e. Q* ^1 G# v
网络变压器不能移出DDR走线区域吗，我觉着这个有问题，一般DDR走线不要跨区域，还有一般是时钟线长吧，或者 ...
# u0 {8 g& k) \/ ~7 m" z$ }0 J5 x
这个网络变压器移不走了，板子太拥挤了才这样了，其它板子能跑起来!这个是没办法的，问过硬件工程师，他那个网络变压器在下面是没问题的，他现在也没叫我改，我只想知道为什么跑不起来而已！时钟线要比数据线长吗？就是那个CLK时钟线
! q, @7 W  A; o4 e  W0 s5 A$ s  z, p2 s1 P0 [5 M1 U

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小秋2013
理论上是时钟线最长，你最好看看芯片资料，里面应该有这方面的要求的。  详情 回复 发表于 2017-5-25 17:00

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Trista

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 楼主| 发表于 2017-5-31 15:37 | 只看该作者
ALLEGROPCB 发表于 2017-5-27 10:19
0 `+ b6 m: q" B# f" j) J你这个跑步起来很正常，一般时钟最长， 具体看芯片指南，有一些芯片，是数据线和时钟误差不能超过600. 。。 ...

: F3 p3 F( f8 \+ X+ _  V. M& p& c6 a你好，不好意思，文件公司不让上传的！另外画的一个板子，数据也比时钟长，大概是在500MIL内，能跑起来，这个跑不起来的板子，结构有限制，板子太小，CLK时钟无法走比数据线长，现在怀疑是信号完整性问题，重新改板，到时看看能不能跑起来- N/ y2 @9 G4 ^  B

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 楼主| 发表于 2017-5-31 15:30 | 只看该作者
superlish 发表于 2017-5-26 18:28: A( C9 G7 |/ x/ p9 j1 ~+ P" m- K
这三根是否是需要等长的？你这里差的好大啊  （有PIN延时吗？？ DDR2就用单端1根DQS，有要求全等长的，不知 ...
& x* Z" y( E( @, |$ _3 e
没有等长，你指的三条信号线是MDQS0，MDATA7和MDATA5.MDATA7和MDATA5是等长的
* N6 h& L% I- [9 e7 P* R3 J% X" H8 O

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丁少_bmPRb

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3#
发表于 2017-5-25 14:04 | 只看该作者
你真行，首先布局就有问题、然后DDR走线没有等长。真是浪费钱啊。

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Trista
布局有什么问题呢，可以说说么  详情 回复 发表于 2017-5-25 15:31
Trista
数据线有做等长呀，地址，时钟，命令也做了等长了呀  详情 回复 发表于 2017-5-25 15:30

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王开鑫55

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4#
发表于 2017-5-25 14:19 | 只看该作者
yangjinxing521 发表于 2017-5-25 13:49
0 [: u5 p, B0 O* ]8 _3 Z' m人品。。。。
# O1 C( K" k! e' H! z: y
看看我的帖子DDR怎么跑不起来呢! A! O! ^  [1 V$ @: Y# l4 [

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Trista

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5#
 楼主| 发表于 2017-5-25 15:30 | 只看该作者
丁少_bmPRb 发表于 2017-5-25 14:04
/ }$ ^0 }! c2 m5 n你真行，首先布局就有问题、然后DDR走线没有等长。真是浪费钱啊。
# W( f( ~9 {+ x+ ^
数据线有做等长呀，地址，时钟，命令也做了等长了呀0 n( m2 p6 j1 O3 k  A! T2 A

" }: N- v* T, h" L* N2 J/ t

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Trista

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6#
 楼主| 发表于 2017-5-25 15:31 | 只看该作者
丁少_bmPRb 发表于 2017-5-25 14:04/ I% ^/ M5 S& N/ W! _% I
你真行，首先布局就有问题、然后DDR走线没有等长。真是浪费钱啊。
0 d5 A) O; T* H$ E7 L/ |
布局有什么问题呢，可以说说么, p6 I  X7 p# i4 C

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小秋2013

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7#
发表于 2017-5-25 15:51 | 只看该作者
网络变压器不能移出DDR走线区域吗，我觉着这个有问题，一般DDR走线不要跨区域，还有一般是时钟线长吧，或者看看spc里面的具体要求

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Trista
这个网络变压器移不走了，板子太拥挤了才这样了，其它板子能跑起来!这个是没办法的，问过硬件工程师，他那个网络变压器在下面是没问题的，他现在也没叫我改，我只想知道为什么跑不起来而已！时钟线要比数据线长吗？  详情 回复 发表于 2017-5-25 16:05

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小秋2013

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9#
发表于 2017-5-25 17:00 | 只看该作者
Trista 发表于 2017-5-25 16:05
: @; Y  u5 z  _  _8 T( q  S, }这个网络变压器移不走了，板子太拥挤了才这样了，其它板子能跑起来!这个是没办法的，问过硬件工程师，他 ...
0 x/ {. z' Q0 q8 z/ H1 N2 r& F
理论上是时钟线最长，你最好看看芯片资料，里面应该有这方面的要求的。

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Trista
好的  详情 回复 发表于 2017-5-25 17:50

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Trista

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10#
 楼主| 发表于 2017-5-25 17:50 | 只看该作者
小秋2013 发表于 2017-5-25 17:00( g) _) V" c- S
理论上是时钟线最长，你最好看看芯片资料，里面应该有这方面的要求的。

; |! j% s, U( _4 _1 S2 {7 g+ q好的# C/ k( K( u0 @% R, e

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980155498cai
  • TA的每日心情
    开心
    2020-5-19 15:39

    • 签到天数: 10 天

    [LV.3]偶尔看看II
    11#
    发表于 2017-5-26 01:02 | 只看该作者
    信号质量严重不好，

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    superlish

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    12#
    发表于 2017-5-26 10:45 | 只看该作者
    能不能把整个板子贴出来看下？
    8 \* x  C8 Q* X  k5 V网络变压器下面挖空了那你这块怎么控制阻抗呢？
    ( i/ W& |; w4 P& r1 {  L* {) c（貌似你底下走了这么多线不叫挖空了吧？挖空不了）

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    Trista

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    13#
     楼主| 发表于 2017-5-26 11:16 | 只看该作者
    superlish 发表于 2017-5-26 10:459 p  g; V9 v6 [5 s
    能不能把整个板子贴出来看下？
    7 I3 @# Q. `# n% S' F3 k/ b- @& L网络变压器下面挖空了那你这块怎么控制阻抗呢？! Y* U+ Q6 G  r- F
    （貌似你底下走了这么 ...

    . p8 ?& `7 E* V/ o, ]' e) b; ]# s+ ], F3 S

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    Trista
    板子就这么大，那个是固定位置这样放的  详情 回复 发表于 2017-5-26 11:17

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    Trista

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    14#
     楼主| 发表于 2017-5-26 11:17 | 只看该作者
    Trista 发表于 2017-5-26 11:16

    4 a, _! J% o3 Q" `" f板子就这么大，那个是固定位置这样放的
    6 [9 W. z: }6 A

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    superlish

    该用户从未签到
    15#
    发表于 2017-5-26 17:37 | 只看该作者
    不知道你等长是怎么做的？ 看图示外面那两线相差很大啊，靠板边绕个大圈倒数第二根最长的是DQS吧？

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