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[HyperLynx] DDR仿真网络选择

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发表于 2018-1-11 17:30 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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使用DDR仿真的时候,选择数据网络的时候为何DQ/DM分一起,见图中箭头处。是哪里出错了,如何改正?求教# [: l( v2 P# @" i" ~1 X

2018-01-11_17-24-33.jpg (189.53 KB, 下载次数: 2)

2018-01-11_17-24-33.jpg

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2#
发表于 2018-1-13 10:32 | 只看该作者
前面网络那一步没有问题吗?0 X$ d( U; \8 j8 G
- a" T) }# h& c1 w6 I, N) ~

点评

没有问题,就是软件自动定义仿真网络的时候就把四根信号两两分一起了,不知道是什么原因。  详情 回复 发表于 2018-1-15 10:26

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3#
发表于 2018-1-13 14:58 | 只看该作者
参考差分的形式,你的模型是不是有问题?定义了差分?

点评

有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变化,应该是CPU模型带来的问题,这种情况怎么解决啊?模型里怎么查看?  详情 回复 发表于 2018-1-15 10:29

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4#
 楼主| 发表于 2018-1-15 10:26 | 只看该作者
superlish 发表于 2018-1-13 10:32
2 r/ E. |% S& J; B前面网络那一步没有问题吗?
4 I) }& J" r. {8 Y# k
没有问题,就是软件自动定义仿真网络的时候就把四根信号两两分一起了,不知道是什么原因。
! v5 ^6 O8 i( y/ E

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5#
 楼主| 发表于 2018-1-15 10:29 | 只看该作者
GHOST 发表于 2018-1-13 14:58
8 S! i2 L" h& D" _5 c参考差分的形式,你的模型是不是有问题?定义了差分?
( j2 `% g" Z0 G8 b
有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变化,应该是CPU模型带来的问题,这种情况怎么解决啊?模型里怎么查看?
4 Y) ]% J. y7 Q: R0 K! L# I

点评

直接打开就可以看啊  详情 回复 发表于 2018-1-15 11:53

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6#
发表于 2018-1-15 11:53 | 只看该作者
dhgchina 发表于 2018-1-15 10:297 j; T8 s" J: k# y3 N8 D6 F
有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变 ...
6 Q! p0 [1 ?" U; s
直接打开就可以看啊4 N+ {( U( C) m- G9 E3 b' x; i

点评

问题解决了,确实是模型的问题,DDR3模型里面定义的差分管脚没对应,换一个模型解决了  详情 回复 发表于 2018-1-15 20:27
打开看没问题啊,有什么解决办法没有?  详情 回复 发表于 2018-1-15 17:13

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 楼主| 发表于 2018-1-15 17:13 | 只看该作者
GHOST 发表于 2018-1-15 11:53
. m# W/ j5 }' Y: c直接打开就可以看啊
8 ^8 K7 W4 z& u& ~" `# P" S
打开看没问题啊,有什么解决办法没有?
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2018-01-15_17-10-47.jpg (321.1 KB, 下载次数: 2)

2018-01-15_17-10-47.jpg

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8#
 楼主| 发表于 2018-1-15 20:27 | 只看该作者
GHOST 发表于 2018-1-15 11:53
; o, p$ `  P& ]. k6 I; |- R直接打开就可以看啊

0 s& |$ ?% J( S7 I% k问题解决了,确实是模型的问题,DDR3模型里面定义的差分管脚没对应,换一个模型解决了
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