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楼主: Apple0988
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晒作品(1对2DDR,并列)

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该用户从未签到

31#
 楼主| 发表于 2018-10-20 00:51 | 只看该作者
leleeda 发表于 2018-10-19 16:30% @$ X4 U# H7 r/ Z! y; N
我觉得那个回复说的没有问题啊,本人画了N多年板,接触的也有上千块单板,各种ddr都见过,各种变态要求也遇 ...
, I* t' f! J; h! H3 `# d" Y% K* K
n年是幾年,年份不代表能力,目前就兩種,一種fly by,一種t點,您創造新的做法了嗎,所有誤差10mil  ,clk通通包地20mils,然後差動也要誤差5mils  ,要做多久
: B; J' [+ i3 `2 D7 G9 A0 \8 P' i% m, j  ?, h  |% _$ Y+ A

该用户从未签到

32#
 楼主| 发表于 2018-10-20 01:38 来自手机 | 只看该作者
目前合作過7個ddr一個板子,你所謂的變態也就還好,做的數量多,很多都是簡單的,論壇的出發點美意在於幫助網友解惑,我個人也受到很多網友的幫忙,永遠都有進步空間,未來世界還會把DDR包覆於封裝中。

该用户从未签到

33#
 楼主| 发表于 2018-10-20 08:59 | 只看该作者
leleeda 发表于 2018-10-19 16:30
. ^! q* V4 d+ f我觉得那个回复说的没有问题啊,本人画了N多年板,接触的也有上千块单板,各种ddr都见过,各种变态要求也遇 ...

6 p4 P7 U! r0 b" {, H+ ^& b' \跟您們討論完,我也有個體悟,部門這個版本不是allegro最高階,您們大家使用上還是比較喜歡T點那種設定比較快,我用PIN PAIR設定約花二十分鐘,跟最高階那個版本差也沒有很多時間,如果可以選擇,用您們的做法做也不錯.
7 ^$ }& _% N8 o

该用户从未签到

34#
 楼主| 发表于 2018-10-20 09:07 | 只看该作者
leleeda 发表于 2018-10-19 16:30- \- E* l7 d, q$ |% X7 [
我觉得那个回复说的没有问题啊,本人画了N多年板,接触的也有上千块单板,各种ddr都见过,各种变态要求也遇 ...

2 k: g' N* {; Z; s; M8 W! d, g你放一個你曾經做過,類似這種T點的檔案上來,觀摩一下,我也想看看你的做法.
, R) l+ q0 E' l

该用户从未签到

35#
 楼主| 发表于 2018-10-20 18:05 来自手机 | 只看该作者
Colbie 发表于 2018-10-19 15:27' D$ B$ k3 m* N
总体很不错,因为布线层数相对较少,有一定难度。
4 v+ ?, v4 F! b. n7 |( e建议:1,中间T点的孔可以稍微排列整齐一点(个人有的强 ...

7 h0 F' S6 L, l# M) }8 y抱歉啊,近日情緒比較積動,中間T不對稱是故意的,主因是因等長限制還有包地的要求,真實檔案其實穿越也行,換成十層板就多兩層地,有個可以改近就是繞線gap。
  • TA的每日心情
    开心
    2023-6-5 15:38
  • 签到天数: 51 天

    [LV.5]常住居民I

    36#
    发表于 2018-10-22 11:52 | 只看该作者
    楼主 太牛beer了,第一次见这么漂亮的板子,以我有限的想象力实在想不出还有谁能走出这么漂亮的板子,太帅了!
  • TA的每日心情
    开心
    2021-12-31 15:49
  • 签到天数: 66 天

    [LV.6]常住居民II

    37#
    发表于 2018-10-22 17:59 | 只看该作者
    我研究了下这个板子,楼主所说不用T来实现等长是U55~U2,U55~U1一起做等长是吧,这样就可以实现"T"的分段都是等长的。抛开T型拓布结构,看了下CPU的DDR部分管脚分布,是不是Fly-by更合适呢,地址线2层全部从左边走,右边同时走32位的数据线,2个内层走线应该可以走完,个人的一点看法

    DDR.png (55.61 KB, 下载次数: 3)

    DDR.png

    点评

    我看過飛線 確實非常適合FLY BY  详情 回复 发表于 2018-10-25 17:34

    该用户从未签到

    38#
    发表于 2018-10-23 09:23 | 只看该作者
    5个声望。。。。。。!你这个板还没优化吧?

    点评

    還沒阿 玩玩 練習  详情 回复 发表于 2018-10-23 12:15

    该用户从未签到

    39#
     楼主| 发表于 2018-10-23 12:15 | 只看该作者
    空空换 发表于 2018-10-23 09:23
    + v, V8 m5 k) l$ k; m* J5个声望。。。。。。!你这个板还没优化吧?
    1 T6 S5 x9 M4 V4 M4 ~5 ]# }
    還沒阿   玩玩  練習
    ( Y; {0 K0 c3 i$ U  q

    该用户从未签到

    40#
    发表于 2018-10-23 14:30 | 只看该作者
    基本算及格了,问题不少。8 y1 c  B8 ?) C# x) [8 K3 I0 o4 Y
    1,这个引脚分布应该用菊花,虽然2个菊花,T型都可以。当然你可能只是试试你的等长策略。
    ! R: `; f, B+ C9 F9 v! Y$ O/ ]- ~2,用MATCH GROUP也不复杂,可以尝试我发的skill,只需要5秒设置完。
    * s. k1 W: N5 f, L+ E" S3,等长是时序手段,而不是目的,不绕等长才是最好的,所以画完先优化走线走向看还能缩短不,而不少直接找出最长的直接把其他线长网上靠,同样的,DQ+DQS要求的是组内等长,而不是所有bit等长,0-7即可,而且合理利用组内的DQ互换原则,可以大幅度降低走线长度和绕线复杂程度。我没试,但这么弄出来的绝对比现在好。
    , u5 L* O* p3 l7 U- p! ?4 S4,同上,有了同组同层,你的DQ就简化了,DQS也不用在表面走那么远,这个在高频时候还要考虑表层内层传输速度+过孔长度问题,没必要复杂化
    0 q& K7 C  q& i0 e' D% d% j  u5,相对于时序同样重要的还有阻抗,串扰之类的,临层处理原则是十字交叉,,同向的话错开走亦可。( C4 Z: w9 |# B* H: t6 h
    6,同样的,绕线也是串扰,间距X3以上,时钟有空间继续拉大。你等长做好了,时序好点,但是绕线自己反复耦合信号会很差,眼图将来一塔糊涂,可能还不如不做。

    点评

    這位前輩 高見 你的理論與我們實際面比較相似 當然這板子 我做的很不足 主要原因是Allegro 不夠熟練  详情 回复 发表于 2018-10-25 17:36

    该用户从未签到

    41#
     楼主| 发表于 2018-10-25 17:34 | 只看该作者
    heyan504538 发表于 2018-10-22 17:59$ P4 O+ M. L) X3 q6 k  P) d2 x
    我研究了下这个板子,楼主所说不用T来实现等长是U55~U2,U55~U1一起做等长是吧,这样就可以实现"T"的分段都 ...

    % p0 \; M8 R! j) q1 j我看過飛線   確實非常適合FLY  BY     
    - z# ~2 E2 A7 [+ ]' X8 _, l

    该用户从未签到

    42#
     楼主| 发表于 2018-10-25 17:36 | 只看该作者
    kevin890505 发表于 2018-10-23 14:30
    ' q# K' L# N: k9 E  l3 Z基本算及格了,问题不少。
    4 f# M' E/ e* U5 b! M1,这个引脚分布应该用菊花,虽然2个菊花,T型都可以。当然你可能只是试试你的 ...

    , \. S3 F) C; u4 {4 B- L- d這位前輩  高見   你的理論與我們實際面比較相似   當然這板子  我做的很不足  主要原因是Allegro  不夠熟練5 F0 k) K+ ?3 T% z) |

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    43#
    发表于 2018-12-25 18:36 | 只看该作者
    楼主还是比较牛逼的
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