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3 如何使用Altium Designer 检查原理图

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发表于 2019-5-14 22:32 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 mytomorrow 于 2019-5-17 16:58 编辑 0 A5 m: ]( j" H% |8 ]8 A; {

& g& F* ^, Z$ A  J0 T, o原理图设计完成以后可以使用自带的工具进行检查。
9 m' F/ A' G3 N6 M7 x首先可以目测,原理图中不能出现棕色的波浪线
* Y3 C/ {& Q5 |' q* _ ) v, D8 ]; |0 ^2 `: c* Y+ F

: ^0 M0 b5 \; g6 ~7 ~9 Y5 ?3 Z2 z3.1 编译工程
2 B. A# i$ C6 _$ z3 y& X
+ l& q5 ~: p) B3.2 器件的清单' w0 ~+ k, U. z" q6 j3 q3 F

) S  e7 K0 _5 V0 ]3 s3.3 单独的网络
1 |* }0 E  P' B% V
. |  ~& ^8 |2 s; Q* j( K) Q- ^! t4 q7 V) C. I* x, d: y

5 v. t  l# S2 y& C4 g3.1 编译工程
4 i! y- U. ~' ?3 P- d! ~, S7 `
& Q. I: m0 A7 e# j, a
: l) q7 B; o/ G然后根据
游客,如果您要查看本帖隐藏内容请回复

5 }* \, C  h0 I7 v9 z" c" N( D' I; G$ ^

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发表于 2019-5-15 09:56 | 只看该作者
原理图编译前,建议再多做两个动作:0 W5 A5 c# E, S
0 C0 R5 s' k- [' E
1.设置网络标识范围为全局,这样在多页平行设计或多页分层设计时,不会报告网络找不到的错误- }% m9 K% K, {6 S

7 H9 e2 e  h* |: ]" ^' \7 k+ Q' D- B2 l! {8 ^; i% h7 _
% e! X" r2 u6 y0 K
7 L- R0 j" z/ O
2.对元件库进行封装检查,根据报告先修改可能错误的逻辑封装,因为原理图编译不对具体元件封装做检查的。
6 ~1 r% _5 Q8 w4 z" O$ [- A & h6 N( H& }7 W0 H7 y+ Q

" a6 J( N1 v! ]4 h6 k' @' v( r6 v/ R

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发表于 2022-7-21 22:55 | 只看该作者
看看                 
4 O! n* X& s5 s) E9 f% {5 ]& N

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推荐
发表于 2021-4-20 19:27 | 只看该作者
原理图        5 q0 _- j( y" A1 @

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2#
发表于 2019-5-15 07:13 | 只看该作者
如果您要查看本帖隐藏内容请+ z* o$ |3 W2 ^; H! @
  • TA的每日心情
    开心
    2021-7-6 15:46
  • 签到天数: 15 天

    [LV.4]偶尔看看III

    7#
    发表于 2019-5-16 11:49 | 只看该作者
    如果您要查看本帖隐藏内容请
      a6 q0 h: ?" Z6 j: o6 L

    该用户从未签到

    8#
    发表于 2019-5-20 13:27 | 只看该作者

    该用户从未签到

    9#
    发表于 2019-6-27 15:51 | 只看该作者

    该用户从未签到

    14#
    发表于 2020-4-4 22:44 | 只看该作者
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