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3 如何使用Altium Designer 检查原理图

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发表于 2019-5-14 22:32 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
本帖最后由 mytomorrow 于 2019-5-17 16:58 编辑 8 A- n2 F" J: Q+ J' W
- W+ f8 u+ S5 }1 J) A) z5 y# p
原理图设计完成以后可以使用自带的工具进行检查。
* D7 C3 R% |( C/ Y3 P+ e) j, G首先可以目测,原理图中不能出现棕色的波浪线 4 {& ]1 O9 w: t7 B7 a

( d& l- G9 H) b( o
6 n6 M- ?* U, D5 S1 @% O2 g3.1 编译工程) H  w% T. X' J
* s! q0 k- R, ^9 ?/ ~% B
3.2 器件的清单/ v4 X1 f4 A" ]# I: ]# B' ^' t9 C

. h0 D0 S' f& i# D9 n9 \/ n' K3.3 单独的网络
# k* g$ Y* i6 o- U+ s: B
% }5 w* P  h8 F/ k+ \2 F, Y
" M4 P0 }3 T2 u: O' O2 p4 Q
& @; {4 n) T* `3.1 编译工程( L3 o+ v' \0 [. @- K
" V7 C; f, `- o  s
; X) S( W4 N2 m/ C8 s) f
然后根据
游客,如果您要查看本帖隐藏内容请回复
" d- l) p" ~9 ~/ @2 Z

. F9 {, B# \1 z

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发表于 2019-5-15 09:56 | 只看该作者
原理图编译前,建议再多做两个动作:
0 b$ u! ]% c3 Z- \; p& \* U
2 x1 o) x: W5 x6 p$ \4 Z1.设置网络标识范围为全局,这样在多页平行设计或多页分层设计时,不会报告网络找不到的错误
0 \8 o. u, v7 C+ A , b/ |$ j) i, o( n& {& `
5 _/ B3 V! z9 _3 [8 H7 q

. k6 o( ?$ o6 C" o! L" f" [/ A3 @* u) N' `9 P, \# x
2.对元件库进行封装检查,根据报告先修改可能错误的逻辑封装,因为原理图编译不对具体元件封装做检查的。6 L6 t8 a' j9 L; O2 |: J2 _* p) D6 X6 r
* G4 w, _( v4 Y+ P
# P+ ]8 }2 B+ l5 T) q- C

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发表于 2022-7-21 22:55 | 只看该作者
看看                 
( K$ x9 e% }8 Y, s  f5 `

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发表于 2021-4-20 19:27 | 只看该作者
原理图        
" k$ ^4 B# g1 X- ^* |% I- K8 ]

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2#
发表于 2019-5-15 07:13 | 只看该作者
如果您要查看本帖隐藏内容请/ Q9 j# R& y! ^
  • TA的每日心情
    开心
    2021-7-6 15:46
  • 签到天数: 15 天

    [LV.4]偶尔看看III

    7#
    发表于 2019-5-16 11:49 | 只看该作者
    如果您要查看本帖隐藏内容请
    " h' N8 I$ S3 d

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    8#
    发表于 2019-5-20 13:27 | 只看该作者

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    9#
    发表于 2019-6-27 15:51 | 只看该作者

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    14#
    发表于 2020-4-4 22:44 | 只看该作者
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