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本设计给出了以CycloneII型 FPGA EP2C8为核心的多功能计数器的基本原理与实现% c2 p; L6 p& ]9 s& T. c4 z* U! _
方案。FPGA片内包括测频模块，测相模块，DDS查表模块及NIOSII处理器； NIOS核调节频5 U$ e/ A" k5 h, I
率字与相位字控制DDS查表模块并经片外高速DA DAC900输出正弦波。测频测相模块的片外8 `+ G9 D! Z4 l% C) V, V9 s
输入采用TI公司的宽带运放OPA699放大，并使用TL3116构建迟滞比较器整形为方波送入3 a }" o) E6 a7 m- v$ x
FPGA片内，由可编程逻辑在FPGA内部组建的测频测相逻辑单元，采用等精度测量方法测得' c! O) ?: B( G! T# ~
结果并送NIOS核处理，在LCD上显示。经测试，频率测试范围达到1Hz~14MHz,准确度达) K3 U7 G) z) E/ r' F; B
0.1ppm，相位测量范围0~360°准确度1°，信号灵敏度达到8mvRMS7 ?) u- \7 i* v: S: ^* [# p
: s4 G/ K3 L) F' m
5 E* m, P$ F( U5 P
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发表于 2019-12-13 16:51
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