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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › 测试TDT与TDR问题请教
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[Cadence Sigrity] 测试TDT与TDR问题请教

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发表于 2021-6-18 16:33 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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用speed2000进行ddr的TDR和TDT测试时，一堆如下错误，是什么原因
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ERROR [Via Placement]: Via2452::GND at (13.462mm, 54.991mm) with lower node on Plane$GND02 has a  placement error
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    2#
    发表于 2021-6-18 16:54 | 只看该作者
    可能是过孔连接错误了，用Check检查一下看看

    下载资料威望不够？点击查看获取威望的N种方法>>
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