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Allegro 覆铜求助

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zfc1893
  • TA的每日心情
    开心
    2022-1-22 15:25

    • 签到天数: 1 天

    [LV.1]初来乍到
    跳转到指定楼层
    1#
    发表于 2011-7-27 17:00 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    x
    请问一下,allegro能不能实现如图所示的覆铜方式,就是同覆铜只在元件脚处连接,在PCB走线处自动避开.
    ! g4 i$ e  M/ t6 X" D  ~- z3 K6 [. f模拟电路需要单点接地,Allegro默认的是同网络名自动覆盖,这样原来设计好的单点接地走线又全连到一块了.. s  g4 V6 E7 m3 ?$ V( M: ?
    7 u  p8 q. g/ D# e
    7 X, M* B/ w$ {2 l5 z

    # X" R6 P: U. C" s7 Y 9 ]$ A/ @4 J2 a9 W

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    EDA365微信号及QQ群号！
    longzhiming

    该用户从未签到
    2#
    发表于 2011-7-27 19:00 | 只看该作者
    本帖最后由 longzhiming 于 2011-7-27 19:02 编辑
    8 G, G4 w2 p+ }  R8 e5 \- v! r) R4 K! w5 I0 p+ z! n$ w
    变静态铜修改,如需要再变回动态铜. 也就是覆铜时不指定网络.

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    zfc1893
  • TA的每日心情
    开心
    2022-1-22 15:25

    • 签到天数: 1 天

    [LV.1]初来乍到
    3#
     楼主| 发表于 2011-7-27 19:48 | 只看该作者
    谢谢楼主的,我刚接触这个软件,请问如何修改Shape的电气属性?
    # }( {% w/ J, c4 z" e; V5 c2 I就是原来是连接到GND,如何改成连接到VCC?

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    wangxs_song
  • TA的每日心情
    开心
    2023-10-13 15:24

    • 签到天数: 3 天

    [LV.2]偶尔看看I
    4#
    发表于 2011-7-27 20:54 | 只看该作者
    longzhiming 发表于 2011-7-27 19:00
    # G6 i# [7 l! e9 W/ F变静态铜修改,如需要再变回动态铜. 也就是覆铜时不指定网络.
    5 M9 X7 ?2 E* K$ T) `
    还可以通过CES把相同网络的line-to-spape的间距从0mil改为8mil。5 A) F. o2 r- N
    这样就不用去改静态或动态了。
    " _0 Y( ]1 e2 q7 [' I8 Z' D7 y

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