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请教 如何读波形

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1#
发表于 2008-6-11 17:43 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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请教 从发的波形能看出什么?这个信号是好是坏? 老大说这个信号不好 我却看不出来 请教

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发表于 2013-8-22 14:38 | 只看该作者
时钟信号吧。单从波形就能看出好不好?信号好不好判断的标准是什么?7 x) ]) p6 E/ i9 J

" x5 D1 J; J$ W" R  }建议从几个方面仔细查一下:( h, V5 Q; k) x# B4 I) J
1、接收这个信号的芯片对上下冲的限制。
, P+ K1 |: L' ^( x+ D2、整个产品的EMI要求是否苛刻。7 w, a# y5 L$ D+ X& |& _5 O
3、如果是时钟,这个时钟有没有特殊要求,比如抖动指标之类的。如果有,波形上看不出来,测一下频谱和相噪。
3 r* ]4 f* D$ [  F4、如果是同步总线里面的时钟,你还是加个大一点的串阻吧,几十兆的频率,边沿缓一点无所谓。
0 G3 g6 a" u: |; T2 I5、是否和其他重要信号靠的很近。! D; l8 u/ ~* p
6 v9 i8 \# j" z- \3 e4 Y: b' N
时钟信号不能只看波形的。6 F& N8 W8 j* L& s, B5 M& z% g

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发表于 2013-8-22 13:02 | 只看该作者
看来 过阻欠阻还是要下下功夫才能看懂
  • TA的每日心情

    2019-11-19 16:12
  • 签到天数: 1 天

    [LV.1]初来乍到

    推荐
    发表于 2013-9-9 10:37 | 只看该作者
    我也不懂,进来瞅瞅,没瞅明白。

    该用户从未签到

    2#
    发表于 2008-6-11 19:00 | 只看该作者
    过冲大,欠阻尼。

    该用户从未签到

    3#
    发表于 2008-6-11 19:07 | 只看该作者
    原帖由 hgsky 于 2008-6-11 17:43 发表 2 B7 Y4 r/ m' G3 I* G9 f+ H
    请教 从发的波形能看出什么?这个信号是好是坏? 老大说这个信号不好 我却看不出来 请教

      S8 o4 e+ w' E" V9 T+ A# T, O! V% V. U# w2 ~; L1 A0 }: l' g+ Y
    泰克测的波形?

    该用户从未签到

    4#
    发表于 2008-6-12 14:31 | 只看该作者
    过冲是有点大,但要看实际情况,对其他有没有影响,没影响就没关系

    该用户从未签到

    5#
    发表于 2008-6-12 18:43 | 只看该作者
    只能看出过冲来,怎么看出欠阻尼得

    该用户从未签到

    6#
    发表于 2008-6-12 22:25 | 只看该作者

    问?

    这波行是什么电路里的,哪个点的波形

    该用户从未签到

    7#
     楼主| 发表于 2008-6-13 13:27 | 只看该作者
    原帖由 forevercgh 于 2008-6-11 19:07 发表 ! {) @( E7 ]$ {+ B, Y5 l
    2 S" t. I" Z& _- C" t
    . k! D& M* e2 w7 L0 M) U, q
    泰克测的波形?
    * n9 k5 p3 i/ s( h' L- L
    恩 高手 能不能解释下 你说的意思 过冲大是什么意思

    该用户从未签到

    8#
    发表于 2008-6-15 09:11 | 只看该作者

    过冲与下冲

    过冲就是上升沿的那尖峰,下冲就是下降沿的那尖峰,这样的波形往往EMC也过不了

    该用户从未签到

    9#
    发表于 2008-6-15 11:54 | 只看该作者
    学习

    该用户从未签到

    10#
    发表于 2008-6-15 15:32 | 只看该作者
    原帖由 FLY 于 2008-6-15 09:11 发表
    + O7 l8 {  ]* V* O过冲就是上升沿的那尖峰,下冲就是下降沿的那尖峰,这样的波形往往EMC也过不了

    , V! K( s+ s6 j4 K8 Y( [9 t5 z- |, }( z0 a: u3 ]& _
    过冲就是第一个峰值或谷值超过设定电压——对于上升沿是指最高电压而对于下降沿是指最低电压。! n, K: g8 x6 C
    这是在网上收到的解释。2 B- a: u# R5 a' y% K4 ^) O. g
    到底哪个是对的?

    该用户从未签到

    11#
    发表于 2008-6-16 13:03 | 只看该作者
    波形的好坏要看你的具体要求了。
    & e2 H, J& \# A4 S* F4 Q! Y第一个图过冲小一些,但clk的上升时间也更长一些。第二个图反之。
    2 V- q: v% v, [9 {+ Z
    + M6 A+ I4 P  q& z3 `6 [如果你的emc紧张,或者芯片的承受过冲能力较差,就用第一个图的端接,
    $ [6 b: i, }% z7 S( F1 N( t如果你的timing紧张,芯片以及emc也能承受,就用第二个图的端接。  E# W. C7 x3 N7 z1 N  ^! K  r5 u

    6 L- Q7 N6 y* ]过阻尼和欠阻尼是相对于端接来说的,过阻尼则驱动不够,表现在receiver的waveform上可能信号沿上会有台阶或回勾,信号沿缓慢;欠阻尼就是驱动能力过剩,会造成较大的过冲。

    评分

    参与人数 1贡献 +5 收起 理由
    forevercgh + 5 我很赞同

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    该用户从未签到

    12#
    发表于 2008-6-19 12:22 | 只看该作者

    建议你测量波形对比度时候,横轴的时间刻度要一致。
    6 r! W3 v9 E3 \7 |/ d5 U" q. w
    - V; v# a) W" z7 Q图形2可以再改善一下,毕竟上升沿快,时钟信号就是靠这个边沿,但是EMI就有了,所以再调调。

    该用户从未签到

    13#
    发表于 2008-6-20 13:29 | 只看该作者
    学习!

    该用户从未签到

    14#
    发表于 2008-8-21 23:05 | 只看该作者
    NDK是家晶振厂商吧!. _# u4 b& K3 b  u& b0 Z
    你是测试的晶振的输出波形吗?
    : @5 g0 O& l7 l/ y4 I怎么不是正旋波啊?
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