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[仿真讨论] 急问关于接插件附近反射的问题请教

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1#
发表于 2011-12-30 10:24 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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各位好:
3 j* F$ S: e4 q$ P       小弟想请教一个关于以太网中的一个问题:现在有一块以太网PCB板,该部分由CPU+PHY(单口百兆)+隔变+RJ45组成(带外网管口),分为扣板和主盘,扣板上有CPU+PHY+隔变+RJ45,然后在扣板的隔变上跟PHY的同一侧通过2.54mm的连接器连接到主盘上的隔变+RJ45,现在只焊接CPU+PHY+隔变(主盘)+RJ45(主盘),扣板上的隔变+RJ45不焊接,通过主盘上的RJ45用示波器测试百兆信号的眼图发现眼图有严重的塌陷,压模板情况很严重,通过ping CPU发现有丢包的现象出现,我怀疑是2.54mm的连接器附近阻抗不匹配引起了反射导致信号眼图塌陷蜕化。
  K) T7 j1 K7 f    现在想请问:1、是否是因为反射引起的?5 A1 C/ Y# ^% T: M! J0 M9 U" V
                         2、如果是由于在连接器附近的反射引起的,需要在扣板的连接器(2对差分线)附近做RC或者R到地的匹配吗?0 T0 D- M. V! a  S
这里高手很多,想请教下高手遇到此问题该怎么解决为好?非常感谢!
' W  u" L* X% T( F+ A( r# L7 j                  

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2#
发表于 2011-12-30 13:14 | 只看该作者
1)2.54mm接插件过100ohm差分,阻抗失配是肯定的
. u- r# N; H3 M! A( t7 e2)眼图塌陷也可能和100base-t的驱动模式有关,如果有相关寄存器,调整试试3 d" Z+ a  t, J" g6 Q; _
3)bob smith匹配有没有加* d) N& j% s$ ~# d. X1 h* L% f' T: B
4)phy端的基准源的偏置电阻微调
* c  T, v- A: v# Q/ C1 Y4 f定位的方法:: }  N6 ~" E* j1 G0 H8 R
1)CPU+PHY+隔变+RJ45全用扣板上的,在信号不过接插件的情况下,进行100base-t测试,看是还出现压模板
; _( d) W$ Q' P, a4 q8 }! `8 D5 d, l/ C/ G2)既然有做隔变和RJ45的兼容设计,stub如何处理,是否得当

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3#
 楼主| 发表于 2011-12-30 16:35 | 只看该作者
首先很感谢forevercgh的耐心解答,小弟表示由衷的感谢!
1 }9 ?8 {! I% e对于版主提出的几个问题,我还想继续提个问:# ~( E& f, O5 p0 T1 P2 N
(2)中所说的100base-t的驱动模式具体指的是?一般会在PHY的什么寄存器里设置?+ e/ F" p( [& m) V* z/ l
(3)Bob-smith匹配有加;
3 C# H* e; {8 p& M(4)PHY端的基准源的偏置电阻指的是那个精密的下拉到地的电阻吗?/ K$ U( f/ P. f, X
5 T& g2 m  H' i- _- }5 h* I# N3 |; D9 g
对于定位我已经做了如下实验:" A4 d( Q5 d! a& N! {7 E
(1)不经过接插件,只在扣板上焊接隔变和RJ45,并将隔变与接插件的走线隔断,不留STUB;; w+ i+ A2 {& ?- y1 [; Y
(2)在扣板上直接从PHY出来的差分线飞到下面的隔变,扣板上的隔变不焊接,并将隔变与接插件的走线隔断,不留STUB;" j& E' E6 M/ h5 N7 ]7 q
(3)在扣板上直接从隔变出来的差分线飞到下面的RJ45,主盘上的隔变不焊接,并将隔变与接插件的走线隔断,不留STUB;3 V9 W# f" {  K4 q8 y; g% H
    以上三个实验测试眼图发现均可以通过,虽然有极少部分压模板,但是没有出现塌陷的情况。但是只要经过接插件眼图就有很严重的蜕化现象。所以我怀疑问题就出现在接插件上。$ d1 v2 d) z* q+ R0 n
    我在扣板的接插件2对差分线上分别做了以下实验:
/ ^) O; Y8 v+ o& F( M; q5 ^(1)并49.9欧电阻+10pf电容到地;阻值从47逐渐变换到82欧
$ w1 a! r6 G$ N5 N" P3 [(2)只并10pf电容;
! |) a2 G' |- D) J0 H. p(3)只并5pf电容;
4 L. r" A7 @$ E: s5 ?(4)并47欧-100欧电阻;7 W" ]/ E5 }4 V7 o  R
    以上四个实验中,只有实验一的49.9欧+10pf眼图可以通过,ping包也不会出现丢包的情况;其他的实验均未解决该问题;实验(4)中的并电阻到地可以改善眼图的塌陷情况,但是信号幅值减小了很多,随着电阻阻值的增大幅值有所增大;
2 B) u+ J9 N& ^4 Y    这就是我今天做的一些实验,不知道有没有说服力,还请高手指点!非常感谢!9 t) v2 m' G& I9 N4 s

该用户从未签到

4#
发表于 2012-1-9 10:11 | 只看该作者
可以试试:主板phy后面加两个0欧电阻,一个到主板隔变TR,另一个到连接器,用哪个RJ45就焊接哪个电阻,另一个电阻断开。
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