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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › 求助，allegro等长线设置的问题？
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求助，allegro等长线设置的问题？

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yhcbjnjx

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1#
发表于 2023-6-10 10:39 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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有一组8根总线需要做等长处理，每条网络上有4个器件；但是我只想对网络中的2个器件约束等长，另外2个器件不做约束，应该怎么设置？谢谢大家；' r" v7 W- y" }8 G
比如我只设置每根网络的前两个器件等长；
. X% x2 U5 T( Q7 E% |& f& ^. h8 E( G$ I

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lou1232003
  • TA的每日心情
    无聊
    2022-9-28 15:48

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    [LV.6]常住居民II
    2#
    发表于 2023-6-10 11:11 | 只看该作者
    分段吧  。A到B设等长 A到C设等长

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    aarom
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  • TA的每日心情
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    [LV.4]偶尔看看III
    3#
    发表于 2023-6-10 14:01 | 只看该作者
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    从来到北
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    [LV.1]初来乍到
    4#
    发表于 2023-6-12 19:08 | 只看该作者
    aarom 发表于 2023-6-10 14:013 [0 p9 v8 n: @+ h4 ?
    主要是看零件是否為串聯, 串聯必須設Xnet, 讓總線長有在"誤差內".5 x3 d) b# t9 `/ t2 S2 |( F8 L
    : ~/ E" j3 O: Q+ e
    要分線要設pin pair, 看你要分幾段.

    1 ^7 i9 _1 S6 L' w/ p0 d4 a请问，      在原理图中 为串联二端口器件  使用相同的 net alias 标签  这一操作 能否 替代 为器件设置XNET 这一操作 呢？
    ( x! c$ Y. Y0 {2 w

    点评

    aarom
    主要是看零件是否為串聯, 串聯必須設Xnet, "讓總線長有在"誤差內"."..........已經告訴你要設,因為總長誤差.  发表于 2023-6-24 13:28

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