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[仿真讨论] 封装级电源分配网络PDN阻抗设计需要考虑的频率范围

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    [LV.2]偶尔看看I

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    1#
    发表于 2023-7-5 11:10 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    一般情况,板级电源分配网络只需要考虑100MHz以内(具体根据器件要求)频段的阻抗设计需求,那么封装级设计时一般需要考虑什么频段呢?能不能参考信号完整性与电源完整性那本书上的分段曲线,但好像也不太清楚! b6 m4 w) C8 E  K

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    [LV.8]以坛为家I

    2#
    发表于 2023-7-5 12:08 | 只看该作者
    100~300M左右,更高就要靠片上电容了

    点评

    感谢回答  详情 回复 发表于 2023-7-5 14:30
  • TA的每日心情
    开心
    2024-5-22 15:22
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    [LV.2]偶尔看看I

    3#
     楼主| 发表于 2023-7-5 14:30 | 只看该作者
    dzkcool 发表于 2023-7-5 12:08
    / w6 K: X  ^# h, Y3 s: i# r& h100~300M左右,更高就要靠片上电容了

      V+ t, G7 ^9 J" _( Y7 ~! P感谢回答
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