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关于PCB布线完成后的DRC错误问题

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1#
发表于 2012-9-19 20:40 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
大家好,我在完成布线操作之后,进行DRC检查时,发现总共有40的错误,由于第一次接触这个地方,不是很清楚,所以请大家看看。7 x! M0 T% m6 x1 G
我想问的问题是:每个错误都要一一改正吗?如果需要的话,是不是可以再约束规则设置里更改,或者在PCB Editor上,直接在错误提醒的地方进行改正呢?8 j, U; ?) o; L8 u# R4 t
请大家指教下,谢谢啦。

QQ截图20120919203648.png (62.35 KB, 下载次数: 2)

QQ截图20120919203648.png

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2#
发表于 2012-9-19 20:59 | 只看该作者
错误肯定都要改正,你说的方法都可以

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3#
 楼主| 发表于 2012-9-19 21:07 | 只看该作者
wwddss_1976 发表于 2012-9-19 20:59 & }0 x2 B5 V9 E- r+ U& T
错误肯定都要改正,你说的方法都可以
! @- u$ f( o" T4 H5 V
你好,我想在追加一个问题:
3 K" _2 c4 M6 x下图中,有Required  Value  和Actual  Value 两个对应的提示,Required是我设置的规则,Actual是我实际布线的结果,一般改的话,那个效果相对更好些,还是想你说到的,两种办法都可以?没有好坏之分呢?

QQ截图20120919210443.png (32.62 KB, 下载次数: 0)

QQ截图20120919210443.png

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4#
发表于 2012-9-19 22:04 | 只看该作者
本帖最后由 wwddss_1976 于 2012-9-19 22:08 编辑
5 e! m( ?: |4 w/ O
6 M2 @0 M( F% v你设置规则的时候肯定考虑了某些因素的,因此DRC问题最好是在图上修正,若实在不行再调整约束设置
6 H0 [0 F5 {7 P+ ~* k1 Y另:你图上的元器件放置空间干涉问题,这个要看实际情况。如果你已经完成了布线,可能只有修改约束了,否则工作量太大。

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5#
 楼主| 发表于 2012-9-19 22:11 | 只看该作者
wwddss_1976 发表于 2012-9-19 22:04
+ C- Y0 Q7 l8 G0 F& ]# [4 V$ A2 E你设置规则的时候肯定考虑了某些因素的,因此DRC问题最好是在图上修正,若实在不行再调整约束设置
) n# R3 a7 w& N) Q1 d8 `另:你图 ...
3 q* P( \" d9 u9 j& A: f7 d
恩,明白了,我也这样认为的。% G+ I7 ?( ]9 _  u! H+ N% [
谢谢你啦!

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6#
发表于 2012-9-19 23:40 | 只看该作者
线和线 啊  零件和零件 的必须修的

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7#
发表于 2012-9-20 08:49 | 只看该作者
ji_wei_li 发表于 2012-9-19 22:11
5 P" Q& G) C- d' I5 H恩,明白了,我也这样认为的。/ w" T7 l$ A, }9 Y2 b
谢谢你啦!

0 `' @. [. `7 n$ s/ J+ e你不能只看到工作量大不大的问题,要从原则上原则上分析哪些DRC要修改,同时,如果一开始你设置的规则就是你允许的最小值了,那就算你图已经画完了,也不能修改规则,比如说,你的不同网络的via打在焊盘上了,就算你改规则消掉DRC,但是短路了。所以,建议你先检查规则是否设置正确,然后把不合规则,报错的全部改掉,这样保险
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