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求DDR1 DDR2 DDR3布线规则设置

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  • TA的每日心情
    开心
    2025-7-24 15:33
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    [LV.1]初来乍到

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    1#
    发表于 2012-11-21 17:28 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    求DDR1 DDR2 DDR3布线规则设置:除了数据,地址线分为两组来进行绕等长设置,还有那些线需要进行分组,绕等长之间的公差又是根据什么来设的呢?时钟线将要跟哪些信号线归为一组?请大虾们指点。
  • TA的每日心情
    慵懒
    2025-2-10 15:39
  • 签到天数: 16 天

    [LV.4]偶尔看看III

    推荐
    发表于 2012-12-9 00:39 | 只看该作者
    我把ddr3歸類放上去ddr2ddr1只比ddr3少幾pin分類是一樣的
    0 N3 Z, z7 D( C: L# ]2 L有分兩大類DQ跟AD其中DQ還可再分兩組# j6 q& r/ s, e5 k8 `- X

    7 U/ P" f+ l9 j# G5 z0 B  Q2 U4 k4 s" D
    AD                  DQ1        DQ2
    $ m- D2 P8 m! N2 p6 c' ]SD1_A0        SD_DM0        SD_DM2
    ) `' o) a  K- h$ j( |# KSD1_A1        SD_DQ0        SD_DQ16
    9 K8 `* ~% ]; C% n$ [1 {4 |SD1_A10        SD_DQ1        SD_DQ17- G; b0 n# l* s  d4 N  B
    SD1_A11        SD_DQ2        SD_DQ18
    ( Q; R9 a4 \: \  P9 C6 q- X3 K; {SD1_A12        SD_DQ3        SD_DQ19
      u8 q4 P4 J9 F0 LSD1_A13        SD_DQ4        SD_DQ20) z# h) X7 ?8 ]
    SD1_A14        SD_DQ5        SD_DQ21; x( p  a( x" q
    SD1_A15        SD_DQ6        SD_DQ22& ]5 p+ y3 Q# U9 H" l1 B
    SD1_A2        SD_DQ7        SD_DQ23
    6 ~. @! u  G- \SD1_A3        SD_DQS0-        SD_DQS2-( `6 ?7 x) S5 i7 Q- T- H
    SD1_A4        SD_DQS0+        SD_DQS2+* A7 s+ X; F, q1 P( z
    SD1_A5        SD_DM1        SD_DM3
    : t4 D" {6 z* h' {) XSD1_A6        SD_DQ8        SD_DQ245 Z5 B2 ~( _% }3 p8 _! O' ~8 f& o
    SD1_A7        SD_DQ9        SD_DQ25! l, e; @, P& q+ V( x' R
    SD1_A8        SD_DQ10        SD_DQ266 f8 t! y1 P) f5 Y
    SD1_A9        SD_DQ11        SD_DQ27
    " o: T) I) v- Y, W) z6 \$ ISD1_BA0        SD_DQ12        SD_DQ284 o9 ^3 b# ^) K
    SD1_BA1        SD_DQ13        SD_DQ29
    $ `# E) |: J, a: F2 `+ y. h5 nSD1_BA2        SD_DQ14        SD_DQ30( P% Q* e* m0 ?5 v- X
    SD1_CAS#        SD_DQ15        SD_DQ31
    * @4 u; [7 ?, B# `SD1_CKE        SD_DQS1-        SD_DQS3-) J& X+ D5 f: o. g' h
    SD_CLK0-        SD_DQS1+        SD_DQS3+4 x7 r+ e% b( o9 R/ [2 f- ^3 ~7 Q
    SD_CLK0+               
    5 I' z" R; ^. B, ^! MSD_CLK1-               
    & A% R) Q( T; Q3 ?, h6 u( ^SD_CLK1+               
    + T( Z/ l9 |+ [6 t0 m  t; {SD1_CS#               
    . }0 C% w, k- k0 NSD1_ODT                ) S5 B9 r) L( y* I
    SD1_RAS#               
    + o0 b! |; J2 g1 I/ F' q9 u  VSD1_RESET#               
    ) P+ h, C& l2 d/ p0 LSD_STBC_CKE               
    , L" h' p6 G3 T6 }( }" M" \SD1_WE#                # A. A8 O2 g- m* U/ Z: D

    该用户从未签到

    2#
    发表于 2012-11-21 19:12 | 只看该作者
    1、时钟线和地址线设为一组,并且等长要以时钟做参考
    ) |; L3 x! @) t2 @2、等长公差的话随着速率的提高要依次减少,ddr3的公差可以控制在15mil( X: E/ B% [+ m, [' i6 M% A5 t
    3、数据线和地址线要完全取分开,不能交叉走线
  • TA的每日心情
    开心
    2025-7-24 15:33
  • 签到天数: 1 天

    [LV.1]初来乍到

    3#
     楼主| 发表于 2012-11-22 11:20 | 只看该作者
    谢谢!还有一些控制线,如DM,DQ......,这些控制线是跟数据线还是地址线在一组呢?地址线要以什么信号线为参考呢?

    该用户从未签到

    4#
    发表于 2012-11-22 11:52 | 只看该作者
    love365 发表于 2012-11-22 11:20 ! m: s: e( r+ s5 d0 K1 A, p( i
    谢谢!还有一些控制线,如DM,DQ......,这些控制线是跟数据线还是地址线在一组呢?地址线要以什么信号线为参 ...
    & ~2 G3 R6 _; e
    dqs、dqm是要和数据线分为一组,其余的像we,cs之类的就归到地址组,地址组的等长以时钟线为参考

    该用户从未签到

    5#
    发表于 2012-11-27 23:04 | 只看该作者
    同求

    该用户从未签到

    6#
    发表于 2012-11-28 01:33 | 只看该作者
    tomyqg 发表于 2012-11-27 23:04 , b+ _( u; Q& I- H) ?8 ?4 `" k: p
    同求

    2 ?( V  c2 z/ c8 H+ q$ u9 d7 U% j* P多看看intel公司主板设计指引,上面分组讲得比较清楚

    该用户从未签到

    7#
    发表于 2012-11-28 11:00 | 只看该作者
    andyxie 发表于 2012-11-28 01:33 9 g! p4 a+ c1 W9 o
    多看看intel公司主板设计指引,上面分组讲得比较清楚
    0 B. F6 S# C, r+ D# Z
    andyxie  能发一份到  LEESE2002@163.COM 吗?谢谢!

    该用户从未签到

    8#
    发表于 2012-12-4 23:22 | 只看该作者
    新人学习!!

    该用户从未签到

    9#
    发表于 2012-12-6 08:34 | 只看该作者
    andyxie 发表于 2012-11-28 01:33
    ) k8 i9 V, w, J* _" p+ |; \8 o多看看intel公司主板设计指引,上面分组讲得比较清楚

    8 t& a& f7 j( r' ~求大侠也给我发一份吧。邮箱:237564880@qq.com

    该用户从未签到

    10#
    发表于 2012-12-6 08:48 | 只看该作者
    andyxie 发表于 2012-11-28 01:33 - h) k" L& S5 f
    多看看intel公司主板设计指引,上面分组讲得比较清楚

    ! r+ T& s) s( Q7 H% D+ {9 H同求大侠发份,邮箱:675609122@qq.com,谢谢~!

    该用户从未签到

    11#
    发表于 2012-12-7 21:42 | 只看该作者
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