请高人指点：为什么创建网表文件时总是提示错误？

wfc_02

工程文件、元器件库及创建网表的log文件.rar (681.32 KB, 下载次数: 14)

2014-1-6 08:56 上传

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8 I$ R- w) }4 ]7 g
各位坛友好！  
' n/ N8 |' P1 H+ P2 {最近我在学习candence 过程中遇到一个问题：我用坛友推荐的于博士的原理图工程文件，重新进行DRC校验通过，但是创建网表总是有告警和错误提示，按照提示自己尝试了解决，但始终找不到问题所在。请坛子里的高人给指点一下，这些问题该怎么解决。先谢谢各位了！  

jacklee_47pn

在我這兒沒問題! 請看圖片。 可能是你軟件版本或是補釘版本問題。

wfc_02

先谢谢你的帮助！
1 y) J9 D: C5 {" w* K请问你在创建网表之前有没有更改哪些东西？

jacklee_47pn

因為我是16.6版，所以改了路徑，請看圖片。

wfc_02

谢谢斑竹详细的指导。
+ m0 ~( B% S+ q0 h$ u! c( d/ L我使用的是16.3，allegro.cfg文件的路径之前我改过，创建也不成功。按照错误提示#5 Error   [ALG0013] Conflicting values of following Component Instance properties found on different sections of U6.
% \2 ^9 l; V0 o$ g; @6 R字面意思应该是U6个部分的属性值有冲突，我查看了一下U6总共分了4部分，看他们的属性设置，也没有发现冲突的地方，郁闷中.......
, }0 o! r3 u7 z

2 o) H8 c% P4 C$ d0 A6 X. Z' P0 _

wangjinqiu_05

用你给的SCh  16.3也没问题啊！
% B# x' _% j! ^5 `9 H
5 D1 Y& @8 j5 n********************************************************************************
*
* Netlisting the design
+ [/ Q- L" o6 ~0 d*
********************************************************************************
Design Name:
1 D; z' F! q4 B, O2 Ad:\tddownload\1\mysch\myproj.dsn
" M6 ?/ G/ c) v6 mNetlist Directory:
D:\TDDOWNLOAD\1\MYSCH
Configuration File:
8 x, I2 c, \4 x% I; c' wD:\Cadence\SPB_16.3\tools\capture\allegro.cfg
9 F2 j! q; g' l, c1 D) |0 O
+ Z- [4 v, X" Q6 v1 {3 YSpawning... "D:\Cadence\SPB_16.3\tools\capture\pstswp.exe" -pst -d "d:\tddownload\1\mysch\myproj.dsn" -n "D:\TDDOWNLOAD\1\MYSCH" -c "D:\Cadence\SPB_16.3\tools\capture\allegro.cfg" -v 3   -l 31 -s "" -j "PCB Footprint"
% y3 B1 [' e9 t& s' [$ b#1 Warning [ALG0051] Pin "GND" is renamed to "GND#1" as visible power pin of same name already exists in Package AUDIO_RJ_0 , J6: SCHEMATIC1, OPA_BUF (360.68, 53.34).
#2 Warning [ALG0051] Pin "GND" is renamed to "GND#6" as visible power pin of same name already exists in Package AUDIO_RJ_0 , J6: SCHEMATIC1, OPA_BUF (360.68, 53.34).
( [( B! w9 m$ M- Q9 I2 O" V5 q3 `3 ~#3 Warning [ALG0016] Part Name "SW PUSHBUTTON-DPST_RESET_DSP-RESET" is renamed to "SW PUSHBUTTON-DPST_RESET_DSP-RE".
#4 Warning [ALG0016] Part Name "TMS320C6713GDP_BGA272DSP_TMS320C6713GDP" is renamed to "TMS320C6713GDP_BGA272DSP_TMS320".
* O2 s, A# K& ~. ^#5 Warning [ALG0016] Part Name "MT48LC2M32B2B5-6_SDRAMTSOP86_MT48LC2M32B2B5-6" is renamed to "MT48LC2M32B2B5-6_SDRAMTSOP86_MT".
; ^+ Q5 f6 @6 b1 |1 M, j% c#6 Warning [ALG0016] Part Name "SST39VF800A_SST39VFTSOP48_SST39VF800A" is renamed to "SST39VF800A_SST39VFTSOP48_SST39".
Scanning netlist files ...
9 N8 c1 O+ w3 @  {9 d7 K
Loading... D:\TDDOWNLOAD\1\MYSCH/pstchip.dat
. [* y& z+ N( U& {
Loading... D:\TDDOWNLOAD\1\MYSCH/pstchip.dat
( _( `1 Z' ~1 S3 `0 d3 O
. ~! a8 |* C, p2 ~Loading... D:\TDDOWNLOAD\1\MYSCH/pstxprt.dat

6 F7 D* u2 q1 H  o$ [, C& }8 g+ BLoading... D:\TDDOWNLOA
, q, X* y4 K4 G' \5 DD\1\MYSCH/pstxnet.dat
6 A' P% R3 N2 J5 `packaging the design view...

1 X9 B4 z9 S7 d6 dExiting... "D:\Cadence\SPB_16.3\tools\capture\pstswp.exe" -pst -d "d:\tddownload\1\mysch\myproj.dsn" -n "D:\TDDOWNLOAD\1\MYSCH" -c "D:\Cadence\SPB_16.3\tools\capture\allegro.cfg" -v 3   -l 31 -s "" -j "PCB Footprint"


9 H3 ^  B+ s- H) `8 I*** Done ***

jacklee_47pn

wfc_02 发表于 2014-1-9 15:29
% C! e; Y- ?  F: H2 s$ X8 M. X/ ]* s谢谢斑竹详细的指导。
我使用的是16.3，allegro.cfg文件的路径之前我改过，创建也不成功。按照错误提示#5  ...

就已經跟你說了，在我這兒沒問題! 目前可能是你軟件是打哪一版本的補釘問題。

wfc_02

好的 ，谢谢两位的热心帮助。