PCB中，串扰怎么办？

2023-10-13 17:19| 查看: 100| 评论: 0

摘要: 在PCB布线中，避免串扰的设计和布线技术有：1.根据功能分类逻辑器件系列，保持总线结构被严格控制2.元件间的物理距离最小化3.最小化布线走线长度，必要时可采用JOG方式布线，即对平行线长度很长的两根信号线，在布线 ...

在PCB布线中，避免串扰的设计和布线技术有：

1.根据功能分类逻辑器件系列，保持总线结构被严格控制

2.元件间的物理距离最小化

3.最小化布线走线长度，必要时可采用JOG方式布线，即对平行线长度很长的两根信号线，在布线时，可以间断式地将间距拉开，这样既可以节省布线资源，也可以有效的抑制串扰

4.元件要远离I/O口互联接口及其它易受数据干扰及耦合影响的区域

5.对阻抗受控走线或者频谱能量丰富的走线提供正确的终端

6.避免相互平行的走线布线，提供走线间足够的间隔（最小化电感耦合）

7.相邻层上的布线要相互垂直（防止层间电容耦合）

8.降低信号到地的参考距离间隔

9.降低走线阻抗和信号驱动电平

10.隔离布线层（背板层叠设计）

11.将高噪声发射体（时钟，I/O，高速互连）分割或隔离在不同的布线层上。

12.高速信号线在满足条件的情况下，提供正确的终端电阻

13.将长时钟走线和高速并行走线更接近参考层

14.对于微带线和带状线，走线高度限制在高于地平面10mil以内

15.在布线空间允许的条件下，在串扰严重的两条线之间插入一条地线。

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