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楼主: zhangjunxuan21
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晶振两根线走线那个更优,为什么?

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16#
发表于 2014-9-1 13:24 | 只看该作者
个人感觉要看情况吧,我有的客户就喜欢用第一种方式走线(有的还建议等长),

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17#
发表于 2014-9-1 14:19 | 只看该作者
个人切身体会,还是第一种好。有次我们的32k晶体没有走差分线就是不起振,后来改成差分走线,问题解决2 ^6 N* D. K# @3 Y5 Y# w

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18#
 楼主| 发表于 2014-9-1 20:09 | 只看该作者
看来这个还真是各说各的理 说也说服不了谁 那就顶起接着讨论
  • TA的每日心情
    擦汗
    2025-9-16 15:00
  • 签到天数: 16 天

    [LV.4]偶尔看看III

    19#
    发表于 2014-9-2 12:07 | 只看该作者
    晶振2个pin的信号相差180度,所以要类差分线处理最好。走线要短。线宽没有多少要求。

    点评

    为什么相差180度? 为什么相差180度要走差分? 明明是模拟线来的啊,一根进,一根出。[attachimg]172277[/attachimg]  详情 回复 发表于 2019-2-19 16:27

    评分

    参与人数 1贡献 +5 收起 理由
    zhangjunxuan21 + 5 支持!这个说法有点说服力啊 顶一个

    查看全部评分

    该用户从未签到

    20#
    发表于 2014-9-2 22:19 | 只看该作者
    个人感觉,都差不多,因为线短。

    该用户从未签到

    22#
    发表于 2015-4-1 14:52 | 只看该作者
    本帖最后由 layout小二 于 2015-4-1 14:53 编辑 , p: E: E! K$ T3 D* E5 t
    1 G  ^& N! r) w% a
    分开点好吧、、我们硬件说分开中间铺上地打上地孔,降低噪声,干扰最重要。

    该用户从未签到

    23#
    发表于 2015-4-2 12:44 | 只看该作者
    个人感觉方案一比较好一些,现在的走线长度远远没有超出长度范围,方案一耦合效果会好一些,如果因空间原因布局时距离较远可以采用第二种方案,这样可以最大限度的缩短走线长度

    该用户从未签到

    24#
    发表于 2015-4-3 14:25 | 只看该作者
    我想知道这种问题有没有办法去仿真评估一下,很多时候都是经验说哪个好,但是都给不出数据上的说明,然后这样画板就很没有意思了

    该用户从未签到

    25#
    发表于 2015-4-3 23:08 | 只看该作者
    第二种会好点儿;晶振是干扰源,要求线路最短,还要掏空避免受热源影响!

    该用户从未签到

    26#
    发表于 2015-4-3 23:25 | 只看该作者
    就一个PCB说明没办法说哪个走线好,有部份晶振好像是+/-这样的信号,建议靠近走,有一部份是in / out ,这样就要离远一些,减少不必要的串扰,所以说最好给个原理图的截图,更能说明问题。) `' q# k) E/ L& \
    再说句实话,一般的PCB设计人员都更喜欢方法1,咋说都说不通,头疼。。。。。基本上都是会了一个办法,所有的晶振都按一个办法搞,美其名曰:我做的晶振从来没有出过问题。  我无语中。。。。

    点评

    确实很多人喜欢用第一种...我一般都是第二种,而且尽量对中,跟楼上的以为朋友一样,强迫症....除非领导强迫我走第一种!!!现在在画的板就是被强迫用第一种,还拉得好远,并且不得不在晶振下面走其他线....就为了  详情 回复 发表于 2015-6-5 15:35

    评分

    参与人数 1威望 +2 收起 理由
    zhangjunxuan21 + 2 哈哈 深有体会 很多时候都是我以前搞的都没.

    查看全部评分

    该用户从未签到

    27#
    发表于 2015-4-5 16:31 | 只看该作者
    这个只要短点,我看就行了,主要是晶振和IC的配

    点评

    还有电容!  详情 回复 发表于 2015-6-5 15:37

    该用户从未签到

    28#
    发表于 2015-4-5 19:32 | 只看该作者
    答案不就在3楼吗,很明确的是晶振内部是一个反向缓冲器,两根线一个为输入,一个输出,根本不需要差分耦合关系  至于起振不起振是不是你的示波器探头带宽不够?是不是你的匹配电容不对,等等原因很多

    该用户从未签到

    30#
     楼主| 发表于 2015-4-8 09:45 | 只看该作者
    看大家这么热烈的讨论改问题,分享一份厂家推荐晶振的layout指导内容,虽说没有说明哪种方式更好,但是依然有些可以借鉴的地方,大家可以分享更好的资料,希望该贴有个比较专业的回答' h# v% O9 D6 s/ J! J$ x1 ~

    1.png (204.38 KB, 下载次数: 10)

    1

    1

    AN10006-Best-Design-Layout-Practices.pdf

    248.67 KB, 下载次数: 176, 下载积分: 威望 -5

    点评

    最后一句翻译可能不妥,应该是,如果有别的什么差分线要布时,布成等长。因为晶振不是差分信号啊。 我这有ST公司的PCB布线建议:  详情 回复 发表于 2018-11-10 16:32
    从这段话中,能读出的一个信息是走线越短越好 口气说的比较肯定,而走差分要求等长只是一种推荐的语气,所以或许第二种方式更被认可,希望大侠们接着讨论  详情 回复 发表于 2015-4-8 09:51
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