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EDA365电子论坛网»电子社区 › 研发技术版块 › 芯片SIP|封装设计 › Ansys siwave导入Cadence SiP设计文件报错
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Ansys siwave导入Cadence SiP设计文件报错

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tencome

该用户从未签到
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1#
发表于 2020-2-29 14:39 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 tencome 于 2020-2-29 14:41 编辑
% Q) k4 K3 Z% D: G5 |: H* k- o' H4 M
问下老师，先安装的SiP 17.2版本可以正常使用， 后安装的siwave （版本2018.0）也可以正常打开siw文件， MCAD转换工具也装了。 ! G+ q7 v9 U  Y) O9 O" a/ d. C: ?" ]

7 {  q5 v, y: _) Y/ [0 [但是在使用Siwave导入 SiP文件的时候，会出现导入错误，请教一下老师是哪个地方少设置了么？6 Q: Z! e' R# l3 `; p

( k- q! g" x% Y
8 ?* G5 H% c! i

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yin123
  • TA的每日心情
    怒
    2019-11-29 15:37

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    [LV.1]初来乍到
    2#
    发表于 2020-2-29 16:47 | 只看该作者
    帮你顶一下：Ansys siwave导入Cadence SiP设计文件报错

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    amao

    该用户从未签到
    3#
    发表于 2020-2-29 17:55 | 只看该作者
    需要装allegro

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