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EDA365电子论坛网»电子社区 › 研发技术版块 › 芯片SIP|封装设计 › Ansys siwave导入Cadence SiP设计文件报错
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Ansys siwave导入Cadence SiP设计文件报错

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tencome

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发表于 2020-2-29 14:39 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 tencome 于 2020-2-29 14:41 编辑 8 e% n) O/ ~# G8 p5 X$ X( c5 u: C

; O7 G: |0 o& T8 R, l  L7 p问下老师，先安装的SiP 17.2版本可以正常使用， 后安装的siwave （版本2018.0）也可以正常打开siw文件， MCAD转换工具也装了。 # d9 N9 Q8 Y& O" m2 F

  q, R2 q4 Q* L. }: C' o) g' @* P但是在使用Siwave导入 SiP文件的时候，会出现导入错误，请教一下老师是哪个地方少设置了么？9 \, x7 H. j6 s1 g  N3 y
, b1 _& q+ k8 d, q# n3 D

  T( ]/ ]" K' \) F& h

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yin123
  • TA的每日心情
    怒
    2019-11-29 15:37

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    [LV.1]初来乍到
    2#
    发表于 2020-2-29 16:47 | 只看该作者
    帮你顶一下：Ansys siwave导入Cadence SiP设计文件报错

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    amao

    该用户从未签到
    3#
    发表于 2020-2-29 17:55 | 只看该作者
    需要装allegro

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