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楼主: forevercgh
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【原创】理性认识SQ的时序仿真功能(不断更新中)_如需转载,请务必征得作者同意

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该用户从未签到

451#
发表于 2012-5-14 13:48 | 只看该作者
看看,有意思!基础太差啦!

该用户从未签到

452#
发表于 2012-7-13 14:03 | 只看该作者
非常好,板凳学习
  • TA的每日心情
    开心
    2023-11-30 15:49
  • 签到天数: 1 天

    [LV.1]初来乍到

    453#
    发表于 2012-7-16 21:43 | 只看该作者
    个别图片看不到。

    该用户从未签到

    454#
    发表于 2012-8-2 12:00 | 只看该作者
    貌似楼主不来了哎。。。好几年都没更新了

    该用户从未签到

    455#
    发表于 2012-10-23 21:14 | 只看该作者
    有人做总结吗?

    该用户从未签到

    456#
    发表于 2012-11-13 10:32 | 只看该作者
    实际上,时序分析,就是为等长做服务的。。。但有一个存在的问题是,很多芯片厂商已经把相关的等长设计、拓扑结构提供了,一般情况下,按照他们所提供的信息来做PCB设计就可以了。。但是 从小,老师就教育我们,对于一个问题 ,我们不仅要知其然,而且还要知其所以然,这样,才不会被人忽悠。。 最后,还是坐等 forever 版主 和 COMS 发帖啊

    该用户从未签到

    457#
    发表于 2012-12-5 22:26 | 只看该作者
    学习西学习西
  • TA的每日心情
    奋斗
    2023-7-11 15:12
  • 签到天数: 1 天

    [LV.1]初来乍到

    458#
    发表于 2013-1-11 10:52 | 只看该作者
    希望楼主能够继续更新时序设计……

    该用户从未签到

    459#
    发表于 2013-2-1 16:34 | 只看该作者
    顶一下

    该用户从未签到

    460#
    发表于 2013-2-8 16:26 | 只看该作者
    来学习

    该用户从未签到

    461#
    发表于 2013-7-5 10:49 | 只看该作者
    大师级的帖子,感谢几位版主!

    该用户从未签到

    463#
    发表于 2013-11-24 13:43 | 只看该作者
    不错 非常感谢 呵呵 顶支持

    该用户从未签到

    464#
    发表于 2013-12-16 16:05 | 只看该作者
    问下,如果我们直接使用IBIS模型,外接测试负载,测量电压到VMEANS的时间是得到的bufferdelay还是得到的就是包含logic delay的TCO呢?

    该用户从未签到

    465#
    发表于 2013-12-16 16:06 | 只看该作者
    forevercgh 发表于 2008-4-24 10:382 u4 t6 o# ^- J/ l' M- c: n
    兵马未动,粮草先行。
    5 G0 ]% R& M5 L6 P- z6 c2 b' k先从时序分析的一些概念入手。* E7 \- ^: P% t6 g6 g! ~  I- ?
    % b/ j9 e$ z  |: D! a) A
    问下,如果我们直接使用IBIS模型,外接测试负载,测量电压到VMEANS的时间是得到的bufferdelay还是得到的就是包含logic delay的TCO呢?
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