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Cadence Allegro论坛今日: 8 |主题: 34054|排名: 5

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cadence16.2的安装 2人参与	liyuesheng_yz 2012-5-22 22:06	2 981	woody 2013-6-3 11:56
谁有PADS高版本的帮忙转成allegro，急急急急！！ 2人参与	ayalcy 2013-6-2 16:47	3 658	ayalcy 2013-6-3 11:02
DDR2源端端接电阻，阻抗匹配，板子加工 9人参与	congbupt 2011-9-23 17:07	6 1856	congbupt 2013-6-3 10:51
Protel导入到PADS再导入到ALLEGRO后的修缮工作？	icekoor 2013-6-2 20:00	0 581	icekoor 2013-6-2 20:00
cadence中在初学时问题总汇（跪求答案） 5人参与	wanghairui168 2013-5-30 07:53	14 1571	wanghairui168 2013-6-2 18:51
对于4层DDR板子的布局攻略希望能给点建设性意见 3人参与	15167890278 2013-5-30 16:44	3 1018	yuzengshu 2013-6-2 18:19
2片DDR2地址线布线T型连接如何设置，以及等长？ 1人参与	zcl2012 2013-6-2 17:09	1 953	yuzengshu 2013-6-2 18:17
ALLEGRO 中如何不显示铜皮? 谢谢了. 9人参与	wan 2008-3-19 22:00	13 7308	httpftpli 2013-6-2 17:52
2片ddr2的地址线公用，如何设置T型连接	zcl2012 2013-6-2 17:10	0 531	zcl2012 2013-6-2 17:10
cadence中如何不让器件导入网表	eda360 2013-6-2 12:02	0 523	eda360 2013-6-2 12:02
BGA里面走差分对求教？ 3人参与	zhangjunxuan21 2013-5-23 20:07	5 984	vivienluo 2013-6-2 11:10
allegro16.3如何设置一组线与一组线之间的间距 1人参与	zcl2012 2013-6-1 22:17	1 530	李明宗伟 2013-6-2 10:17
ALLEGRO如何更改元件位号和网络名？ 2人参与	Aubrey 2013-6-1 22:55	3 3251	Aubrey 2013-6-2 00:38
allegro里如何导入AD的丝印gerber文件	fbc99 2013-6-1 23:28	0 963	fbc99 2013-6-1 23:28
cadence中如何不让器件导入网表	eda360 2013-6-1 22:57	0 429	eda360 2013-6-1 22:57
16.5中xnet的设置	小秋2013 2013-6-1 21:59	0 904	小秋2013 2013-6-1 21:59
如何画线从中间穿过 3人参与	117454615 2013-5-30 10:25	2 727	gdm0121 2013-6-1 20:53
请问，框选板子整块铺铜方法可取不？ 3人参与	hy20060614 2013-5-29 14:52	3 654	hy20060614 2013-6-1 11:39
Allegro 尺寸标注相关信息-分享- 9人参与	123123 2013-5-9 12:07	3 2611	eastsunman 2013-6-1 07:33
谁有cadence15.7 下载地址》？ 3人参与	zhoujun4215047 2013-5-23 20:17	3 876	zhoujun4215047 2013-6-1 01:11
急求双层PCIE连接器的工艺要求 9人参与 - [悬赏 3 金币]	初学滨 2013-5-19 17:38	10 1386	wanily 2013-6-1 01:04
被恶意灌水攻击了 11人参与	ruiquan765 2013-5-23 23:17	8 1221	wanghairui168 2013-5-31 20:19
PCB上空的地方为何要铺铜 3人参与	飞雪飘零 2013-5-25 05:29	3 728	wanghairui168 2013-5-31 19:46
这个丝印这样摆算不算错 14人参与	qhg20360 2013-4-19 00:21	12 1133	wanghairui168 2013-5-31 19:40
技术问题，大家一起来围观吧 3人参与	marco_ma 2013-5-9 18:07	4 766	wu563317339 2013-5-31 17:55