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楼主: jimmy
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★★★ 大家一起评审PCB ★★★

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31#
发表于 2012-6-20 20:37 | 只看该作者
。。。我提的问题都是与那个板子有关的呀,怎么能简单的判定为软件操作的问题呢?
% B7 r4 a! w  o6 c( S/ y; l

该用户从未签到

32#
 楼主| 发表于 2012-6-26 13:30 | 只看该作者
nydragon 发表于 2012-6-20 20:37
  l% C, s" A4 \% M3 l: c$ q+ |" ^。。。我提的问题都是与那个板子有关的呀,怎么能简单的判定为软件操作的问题呢?
: `. E+ I6 _$ p+ X" b+ Z6 H
发到这个贴子吧
$ I0 P4 u) s6 e/ F* Y! P5 M- E) M! ^' J
★★★ 大家一起学PADS(二) ★★★......【有问必答贴】/ ^  |* I+ k5 k6 I8 a4 u0 k# ~' {
https://www.eda365.com/forum.php? ... 63&fromuid=1147
; J) h1 k- X% M
! P# l0 b. [- Y/ B1 m: b# w3 |. ~8 H你的问题都是与板子有关的软件设置问题。0 Q! U$ R  T$ g; v7 w; s! A
: N* h) U2 u) P5 m" V4 s' s

) t. X3 o0 O+ P, I3 E此回复保留一天。24小时后自动删除。& H9 m8 z1 Y& U% G; n

; K) i0 J% o) W2 U, C" B

该用户从未签到

33#
发表于 2012-6-27 09:04 | 只看该作者
4楼的板,虽有4层,但没有一层是比较完整的地,EMC肯定过不去的。

评分

参与人数 1贡献 +6 收起 理由
jimmy + 6 赞一个!

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  • TA的每日心情

    2019-11-20 15:36
  • 签到天数: 1 天

    [LV.1]初来乍到

    34#
    发表于 2012-6-28 08:52 | 只看该作者
    rose_333 发表于 2012-6-27 09:04 / {8 m) H: ^- n% a4 V9 L
    4楼的板,虽有4层,但没有一层是比较完整的地,EMC肯定过不去的。
    , B' Q0 q6 C0 V3 t3 V, @
    嗯,模仿的,试下,不行就换改成六层的

    该用户从未签到

    35#
    发表于 2012-6-28 10:33 | 只看该作者
    这个的浩浩看看,学习学习
  • TA的每日心情
    开心
    2025-7-9 15:29
  • 签到天数: 93 天

    [LV.6]常住居民II

    36#
    发表于 2012-6-28 14:22 | 只看该作者
    提个意见,以后评审内容能否写在板子外面,直接在板子上标注看起来实在太累了

    该用户从未签到

    37#
    发表于 2012-6-28 22:20 | 只看该作者
    本帖最后由 yimiyangguang 于 2012-6-28 23:05 编辑 7 G* T. U/ l$ R+ M5 g+ G
    flywinder 发表于 2012-6-19 15:36 : o: l  Y2 S( S) x0 T; P
    新画的板,4层,4层都走线,不足之处,还望各位大侠多多指教

    $ `. n' V! j' K9 w0 K8 s- m( p) ^我是版主jimmy的徒弟,这是我对你的"欢迎评审"中pcb板的评审!& ^" A/ [7 g& w; ^* N, L7 p- q& M
    9 R8 G& v( K! U  F- c8 Q
    1 数字、模拟部分没有分开布局

    9 H" P8 p. m6 {9 E
    0 f9 Q7 r( V, C9 E0 I' u
    - s8 S& x# H* a( [  |8 K- ]' B
    + o5 @1 K  r7 c& t% ]' ~4 A
    ( i9 @' _0 f! ?  [# W
    2 滤波电容摆放顺序不对,应按照电容阻值先大后小摆放
      ^! U1 s4 P8 p& n. J& N. l0 I! H: i

      ]& z! U' U* A
    " ?; T2 f  e& o, y: f6 y$ q2 I( y6 i' ]* [* i9 \5 t: ?9 I

    8 ?$ T0 L7 {- l- b/ X6 }3 J6 F
    3 布局时要注意,器件的焊盘不能放在其他器件的固定孔上

    / J0 [6 R8 Z* G, A4 c" f! z# C
    * I1 j, _; C6 k$ F  H# i6 V8 m

    ! t% Z, B  k4 k) |; m, |* q
    4 器件距离板框太近
    * j) T1 n+ D) w$ j8 T

    $ _9 n- g: m. ?0 a. z0 s7 p9 F
    5 过孔不要打在器件的焊盘上
    1 @5 ~- E: S% R9 w" X$ i# H5 h+ ]
    4 C% E3 C& W* E9 d. d" w$ p
    6 (a)晶体的两个电容放置时,要使用得分支长度尽量小
    (b)晶体区域内不允许有其它信号走线经过
    (c)晶体附近应打屏蔽地过孔
    (d)晶体两根信号线走成类差分形式
    7 K: S0 ?* F8 ?2 R  y
    # B8 c3 X) [/ G2 |2 q2 u
    ! W& ^, i$ o" H
    7 灌铜时不能出现碎铜

    ( u& K# I" f0 i. ]' C2 g! T. Z* [/ X$ M8 X
    8 电源部分走线需要加粗处理
    ' @3 u* i2 x) P* y& f8 L1 {

    4 b$ h9 k/ _# ^2 o( B
    9 线与线的间距要满足3W原则

    9 \2 y# W! G2 F. r  e
    ' l* a; F, D, V" J7 T8 n
    $ L/ s! J- H2 c9 Y! F- {
    10 走线宽度不能超过焊盘宽度

    ; t/ j8 L% G( @8 ?! W$ Y/ ]: U; a; r8 z5 G& E0 Z8 x$ i
    11 走线时不能出现歪线,直角,锐角连线,

    2 x' D0 J4 W$ t- k% G  E5 ]5 V) r
    $ i4 M1 D0 T! c+ |, d
    12 走线时尽量从过孔和焊盘的中心出线
    : v  L' R* m$ x/ n+ h
    5 D- b. L2 o. X# j7 ?* F
    13 过孔到过孔,过孔到焊盘,过孔到走线、过孔到铜皮的间距太小
    1 I9 @# U! o% H* \
    + v$ \' B% ~; W7 m

    7 c! M8 t& t- S! E* f7 [- t' P+ |( B
    14 板框要进行尺寸标注

    : {1 \% U/ `4 C/ F, U. U% J

    点评

    好给力!  详情 回复 发表于 2016-6-28 22:07
    点评的好得体学习中!  发表于 2012-12-8 09:31

    评分

    参与人数 1贡献 +10 收起 理由
    jimmy + 10 赞一个!

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  • TA的每日心情

    2019-11-20 15:36
  • 签到天数: 1 天

    [LV.1]初来乍到

    38#
    发表于 2012-6-29 09:49 | 只看该作者
    yimiyangguang 发表于 2012-6-28 22:20 5 p' l  n/ D7 n* f
    我是版主jimmy的徒弟,这是我对你的"欢迎评审"中pcb板的评审!7 [; J' I- I/ z2 R* s* u- {2 k' B! D

    ! z6 Y5 E- J9 Y: ?5 r& f# W1 数字、模拟部分没有分开布局

    5 e# b/ h9 G; ?9 x8 Q8 k9 y* T3 B& F; T3 O感谢你给的建议,有个疑问哈,滤波电容不是要先经大电容储能,再小电容滤波吗?那应该是小电容靠近器件端啊。

    点评

    要从电源是从哪里进来的,  发表于 2012-6-29 13:39
  • TA的每日心情

    2019-11-20 15:36
  • 签到天数: 1 天

    [LV.1]初来乍到

    39#
    发表于 2012-6-29 13:53 | 只看该作者
    本帖最后由 flywinder 于 2012-6-29 13:55 编辑
    " N7 X5 X" J! |  T
    flywinder 发表于 2012-6-29 09:49
    & A/ P! f" _4 v9 j8 U! ^# I. M6 v' d感谢你给的建议,有个疑问哈,滤波电容不是要先经大电容储能,再小电容滤波吗?那应该是小电容靠近器件端 ...

    ! Y/ z2 l1 C( r. C6 K3 B% t  K2 l: M1 [" w( c$ j5 o$ S6 N2 @
    ' k4 W- C" d# E9 X6 L8 R( F8 p
    那么这两个电容的顺序应该没错哈,旁边的两个顺序要调换一下(上图2)PS:通过这2个电容给gps供电5 I2 v. `  s3 k3 m$ c
    1 F& u; t8 r/ a2 E2 w, ?, |7 ?
    ! `. D, _- i$ S. Z
    ) Q6 ~+ C; Y/ v; T9 J+ W5 Z
    . ], L9 ]# V& G; ~& l
    ( i6 s, i& s8 ~2 J7 c7 P' ?
    , E5 t$ K5 c( B: s

    点评

    支持!: 5.0
    支持!: 5
    小电容应该靠近 IC 管脚, 没错的.  发表于 2013-8-6 10:28

    该用户从未签到

    40#
    发表于 2012-6-30 10:09 | 只看该作者
    flywinder 发表于 2012-6-29 13:53
    ' Z; G( z. |& z' o" ^2 ~/ G: T, b那么这两个电容的顺序应该没错哈,旁边的两个顺序要调换一下(上图2)PS:通过这2个电容给gps供电
    $ N1 P  M# ?3 O; j/ Z! r) \4 V* X& J+ d) X% ?% j
    ...

    ' F0 D5 ?$ Z1 @- L1 K是的

    该用户从未签到

    41#
    发表于 2012-7-12 16:00 | 只看该作者
    本帖最后由 lwf19861111 于 2012-7-19 08:54 编辑
    - A9 F* J4 r8 y* z( F
    + W1 G# R2 k  [- H" v; b6 t各位高手大家好,有空的话帮忙看看附件中的蛇形走线吧,就是单片的ddr。(其他部分不是本人画的,就那片ddr是我画的)。谢谢

    蛇形走线.rar

    796.82 KB, 下载次数: 773, 下载积分: 威望 -5

    该用户从未签到

    42#
    发表于 2012-7-18 09:18 | 只看该作者
    看了板,你做的等长从美观上还行,但是功能上好像有点不太合适,比如同网络间距不到3w.没有做到9根同层(D【0:7】,DQM),REF走线宽度不足,尤其是在芯片到滤波电容一段,

    点评

    我的大号,就这样登不了了,悲伤啊,在这里悼念一下我的大号。  发表于 2012-10-24 17:51

    该用户从未签到

    43#
    发表于 2012-7-18 11:03 | 只看该作者
    oye

    该用户从未签到

    44#
    发表于 2012-7-24 15:26 | 只看该作者
    9 线与线的间距要满足3W原则0 s9 ~! A# ?3 [% N( \" K
    3w原则上什么啊

    该用户从未签到

    45#
    发表于 2012-7-26 14:29 | 只看该作者
    huangzj 发表于 2012-7-18 09:18 5 o7 W8 I0 y  w4 l
    看了板,你做的等长从美观上还行,但是功能上好像有点不太合适,比如同网络间距不到3w.没有做到9根同层(D【 ...
    5 }: X7 \# s2 |. M3 n
    对于9根同层我想问一下是什么意思,因为我处理器是放top的,ddr是放bottom的,那走线必定会穿过层,能帮我解释一下不?还有什么意见没啊?兄弟们你们别光下载不说话哈。。。。
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