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楼主: jimmy
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★★★ 大家一起评审PCB ★★★

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该用户从未签到

31#
发表于 2012-6-20 20:37 | 只看该作者
。。。我提的问题都是与那个板子有关的呀,怎么能简单的判定为软件操作的问题呢?
2 v% k$ C$ Y8 M4 w. f. z- u

该用户从未签到

32#
 楼主| 发表于 2012-6-26 13:30 | 只看该作者
nydragon 发表于 2012-6-20 20:37
0 w  X* I. \5 L. Z* K。。。我提的问题都是与那个板子有关的呀,怎么能简单的判定为软件操作的问题呢?

1 |& W* R3 J0 K2 R+ Y& e  i& f发到这个贴子吧% x3 c" _* x7 x5 q. e  S3 p

# Y/ y& N) V' }: ]* M★★★ 大家一起学PADS(二) ★★★......【有问必答贴】
9 n( r; q  n4 K  m& k  C  Z1 ]https://www.eda365.com/forum.php? ... 63&fromuid=1147
+ F1 |. K2 [9 @9 \5 ~+ y& H$ [% @$ K0 y9 N4 Y8 g& x/ R
你的问题都是与板子有关的软件设置问题。3 _' z0 }8 ~9 ^2 D
/ V0 O' a" L9 |6 X: M2 }" y1 g

$ S% H& t% L0 h6 n( F此回复保留一天。24小时后自动删除。
) g' P" ], z' T, s$ l; Y, h6 L" Z. U! w" ?3 [6 `5 C* _

该用户从未签到

33#
发表于 2012-6-27 09:04 | 只看该作者
4楼的板,虽有4层,但没有一层是比较完整的地,EMC肯定过不去的。

评分

参与人数 1贡献 +6 收起 理由
jimmy + 6 赞一个!

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  • TA的每日心情

    2019-11-20 15:36
  • 签到天数: 1 天

    [LV.1]初来乍到

    34#
    发表于 2012-6-28 08:52 | 只看该作者
    rose_333 发表于 2012-6-27 09:04 6 N1 k6 v2 {$ g9 F1 B1 A+ [
    4楼的板,虽有4层,但没有一层是比较完整的地,EMC肯定过不去的。
    $ n; ^2 I* o# v- {
    嗯,模仿的,试下,不行就换改成六层的

    该用户从未签到

    35#
    发表于 2012-6-28 10:33 | 只看该作者
    这个的浩浩看看,学习学习
  • TA的每日心情
    开心
    2025-7-9 15:29
  • 签到天数: 93 天

    [LV.6]常住居民II

    36#
    发表于 2012-6-28 14:22 | 只看该作者
    提个意见,以后评审内容能否写在板子外面,直接在板子上标注看起来实在太累了

    该用户从未签到

    37#
    发表于 2012-6-28 22:20 | 只看该作者
    本帖最后由 yimiyangguang 于 2012-6-28 23:05 编辑 * R3 q# p0 K6 `0 r
    flywinder 发表于 2012-6-19 15:36
    $ d- T4 W0 f8 Z; u$ ?新画的板,4层,4层都走线,不足之处,还望各位大侠多多指教

    2 E) ]8 R& P# W5 ~我是版主jimmy的徒弟,这是我对你的"欢迎评审"中pcb板的评审!
    * d6 ?( x$ `9 L6 P# U& c: m/ e- k2 T" @
    1 数字、模拟部分没有分开布局

    & o0 F; p  x; V% l6 t0 Y3 z! |
    ' Y7 ^' |& m3 Z( y+ h* [  v9 A) Y' `4 I; i( O4 I9 O( q

    $ ?! [2 M4 {( c% |7 q! W
    0 Z9 I3 r1 A% c$ z: T# r" |  f
    2 滤波电容摆放顺序不对,应按照电容阻值先大后小摆放
    7 S8 C/ T- h9 E# S; e) K

    ; `, @6 T& F7 _5 q2 C3 [
    * V5 Q! s; d7 m8 f
    $ c6 u& O: d$ p0 C0 m
    / Z, J: v5 w, Y( X2 w! N, T
    3 布局时要注意,器件的焊盘不能放在其他器件的固定孔上
    : [& j  Q4 _$ T
    2 P3 H, P6 q9 m, c2 ]: N) g

    - M: d, c; \' T
    4 器件距离板框太近
    ; x5 X6 ^4 P. n: Y# I* k4 u
    ) B( ?& X4 k2 j7 d  n. u8 W" |

    ' M; F+ S+ E* p0 L5 m. R: A
    5 过孔不要打在器件的焊盘上

    $ [- V$ {' g1 H6 t
    ( Z# s0 v& i  z% ?- ?1 j! E& L
    6 (a)晶体的两个电容放置时,要使用得分支长度尽量小
    (b)晶体区域内不允许有其它信号走线经过
    (c)晶体附近应打屏蔽地过孔
    (d)晶体两根信号线走成类差分形式

    " ~% c0 ]5 t2 i$ [' k2 K
    + E( o( L5 n4 Y2 K) F

    ! W1 ^- i; W% T' P" ?# g
    7 灌铜时不能出现碎铜
    5 k6 ^7 [7 e! `$ ?" k
    8 v- @, Y3 r) X" C9 g. {
    8 电源部分走线需要加粗处理

    ( Q. Y* r7 W# |) F! F4 ?0 C$ a  a& J9 d2 D
    9 线与线的间距要满足3W原则

    ' Q# g6 `4 h, c  E, x
    , |9 ?6 c: |! J# Q& `
    9 ]& O) n! w% S7 w
    10 走线宽度不能超过焊盘宽度

    8 E7 i2 e0 ~6 m# q5 h
    # g) S* f9 e% k$ b
    11 走线时不能出现歪线,直角,锐角连线,
    ) s& B- J- C3 W! l# E* C7 \9 ]6 E

    : G$ u0 D* S. n, U! ?% i
    12 走线时尽量从过孔和焊盘的中心出线
    + A' O2 [% [  ^
    8 l- x/ \. a( D8 U9 Q* }
    13 过孔到过孔,过孔到焊盘,过孔到走线、过孔到铜皮的间距太小

    7 Z) ~' [, W0 d" X1 M$ C! H& X5 n- K# {8 G
    % B/ R9 Y) _% H& M" M7 ^# W
    14 板框要进行尺寸标注
    ) O7 k/ V2 @8 B9 k, o6 f

    点评

    好给力!  详情 回复 发表于 2016-6-28 22:07
    点评的好得体学习中!  发表于 2012-12-8 09:31

    评分

    参与人数 1贡献 +10 收起 理由
    jimmy + 10 赞一个!

    查看全部评分

  • TA的每日心情

    2019-11-20 15:36
  • 签到天数: 1 天

    [LV.1]初来乍到

    38#
    发表于 2012-6-29 09:49 | 只看该作者
    yimiyangguang 发表于 2012-6-28 22:20 * A  E* J8 P3 R$ k2 y& z
    我是版主jimmy的徒弟,这是我对你的"欢迎评审"中pcb板的评审!
    5 z6 k: s# e. o: G5 d2 \8 B' c. L/ Y, F8 I9 h& I+ w
    1 数字、模拟部分没有分开布局
    3 F) G3 ~. L! t2 Y2 u
    感谢你给的建议,有个疑问哈,滤波电容不是要先经大电容储能,再小电容滤波吗?那应该是小电容靠近器件端啊。

    点评

    要从电源是从哪里进来的,  发表于 2012-6-29 13:39
  • TA的每日心情

    2019-11-20 15:36
  • 签到天数: 1 天

    [LV.1]初来乍到

    39#
    发表于 2012-6-29 13:53 | 只看该作者
    本帖最后由 flywinder 于 2012-6-29 13:55 编辑
    / y- u0 W" S4 O$ H& \
    flywinder 发表于 2012-6-29 09:49 6 ^5 A% c2 p) s3 L
    感谢你给的建议,有个疑问哈,滤波电容不是要先经大电容储能,再小电容滤波吗?那应该是小电容靠近器件端 ...

      _( Q2 y6 |& R' `4 n
    8 {- g9 M; P" P8 N- j, e7 V, e
    + }- O; r9 B- W' Y+ h8 l那么这两个电容的顺序应该没错哈,旁边的两个顺序要调换一下(上图2)PS:通过这2个电容给gps供电
    0 s2 c; n% W4 Z
      [& k5 X: w( U- S- B
    ; W: E9 q7 D1 e+ \
      J/ p% a5 g* u* a, `/ g& s1 _' B
    2 h( a' E3 P( P$ t# G4 t. Y0 O& h2 f  F1 S/ c( D

    % k" l& |8 q* v, q. j" E  M& T" J

    点评

    支持!: 5.0
    支持!: 5
    小电容应该靠近 IC 管脚, 没错的.  发表于 2013-8-6 10:28

    该用户从未签到

    40#
    发表于 2012-6-30 10:09 | 只看该作者
    flywinder 发表于 2012-6-29 13:53 + y( h2 M/ g+ [8 F
    那么这两个电容的顺序应该没错哈,旁边的两个顺序要调换一下(上图2)PS:通过这2个电容给gps供电
    2 v4 q9 t# S6 e+ Z/ J2 f
    8 ?& l: ^& U% T8 F! C ...
    * r( y, A7 S6 k, |
    是的

    该用户从未签到

    41#
    发表于 2012-7-12 16:00 | 只看该作者
    本帖最后由 lwf19861111 于 2012-7-19 08:54 编辑 / f9 N/ i/ `  B

    " S  J+ y. `1 a. A8 x$ K" F7 [) f( f各位高手大家好,有空的话帮忙看看附件中的蛇形走线吧,就是单片的ddr。(其他部分不是本人画的,就那片ddr是我画的)。谢谢

    蛇形走线.rar

    796.82 KB, 下载次数: 773, 下载积分: 威望 -5

    该用户从未签到

    42#
    发表于 2012-7-18 09:18 | 只看该作者
    看了板,你做的等长从美观上还行,但是功能上好像有点不太合适,比如同网络间距不到3w.没有做到9根同层(D【0:7】,DQM),REF走线宽度不足,尤其是在芯片到滤波电容一段,

    点评

    我的大号,就这样登不了了,悲伤啊,在这里悼念一下我的大号。  发表于 2012-10-24 17:51

    该用户从未签到

    43#
    发表于 2012-7-18 11:03 | 只看该作者
    oye

    该用户从未签到

    44#
    发表于 2012-7-24 15:26 | 只看该作者
    9 线与线的间距要满足3W原则" u8 o1 ~! i$ x$ f4 P6 L
    3w原则上什么啊

    该用户从未签到

    45#
    发表于 2012-7-26 14:29 | 只看该作者
    huangzj 发表于 2012-7-18 09:18
    6 ^# b0 U/ E. J6 _3 k; y# ~看了板,你做的等长从美观上还行,但是功能上好像有点不太合适,比如同网络间距不到3w.没有做到9根同层(D【 ...
    0 H5 b# y: T: \5 g& v7 N/ m/ L4 m
    对于9根同层我想问一下是什么意思,因为我处理器是放top的,ddr是放bottom的,那走线必定会穿过层,能帮我解释一下不?还有什么意见没啊?兄弟们你们别光下载不说话哈。。。。
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